[發明專利]數據處理指令的許可檢查有效
| 申請號: | 200980143207.1 | 申請日: | 2009-09-30 |
| 公開(公告)號: | CN102197368A | 公開(公告)日: | 2011-09-21 |
| 發明(設計)人: | 威廉·C·莫耶;邁克爾·D·斯奈德;加里·L·惠森亨特 | 申請(專利權)人: | 飛思卡爾半導體公司 |
| 主分類號: | G06F9/30 | 分類號: | G06F9/30;G06F9/46;G06F13/14 |
| 代理公司: | 中原信達知識產權代理有限責任公司 11219 | 代理人: | 李寶泉;周亞榮 |
| 地址: | 美國得*** | 國省代碼: | 美國;US |
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| 摘要: | |||
| 搜索關鍵詞: | 數據處理 指令 許可 檢查 | ||
技術領域
本公開總體上涉及數據處理系統,更具體來講,涉及數據處理系統中的目標裝置的訪問許可。
背景技術
在實現網絡的多處理器或多芯數據處理系統中,使用多個計數器來保持需要各種功能的統計,諸如遞增、遞減和讀改寫操作。因為多個芯可以嘗試同時更新同一計數器,所以產生了網絡延遲并且消耗了大量資源。通常需要用于執行原子更新(即,不間斷的連續更新)的機制。常規的原子更新機制(諸如使用軟件旗語或軟件鎖)會造成系統延遲。為了減少系統延遲,可以使用統計加速器。然而,在單個事務中,通常不能將足夠的信息發送到統計加速器來描述原子操作。
因為計數器位大小可以大于處理器內的寄存器的大小,所以在多個存儲訪問更新計數器的子段時還使用鎖變量來限制對計數器的訪問。當芯需要獲得計數器的所有權來進行原子更新時,對于每個鎖變量而言,可能經過大量的數據處理循環。處理器必須使用處理循環來得到鎖變量,等待鎖變量被釋放(如果該鎖變量已經被另一處理器獲取),執行計數器更新并且釋放鎖變量。由此,系統速度和性能劣化。
附圖說明
本發明以示例方式示出并且不受附圖限制,在附圖中,類似的參考標號表示類似的元素。附圖中的元素是為了簡便和清晰起見示出的并且不必按比例繪制。
圖1以框圖形式示出根據本發明一個實施例的數據處理系統;
圖2以框圖形式示出根據本發明一個實施例的圖1中的數據處理系統的示例性處理器;
圖3以框圖形式示出圖1中的數據處理系統的一部分,其示出了根據本發明一個實施例的處理器和智能存儲器;
圖4以圖表形式示出根據本發明一種形式的用于實現遠離處理器的原子作業的數據處理指令;
圖5以圖表形式示出根據本發明一種形式的事務旁路(lookaside)緩沖(TLB)條目;
圖6以圖表形式示出從處理器傳遞到圖3所示智能存儲器的一部分信息;
圖7以表格形式示出圖3中的智能存儲器所使用的指令操作的示例性編碼;
圖8以流程圖形式示出根據本發明的處理具有許可信息的指令的示例性方法;以及
圖9以流程圖形式示出根據本發明的使用來自處理器的信息來執行許可檢查的示例性方法。
具體實施方式
在此描述了一種用于操作具有處理器和目標裝置的數據處理系統的方法,所述目標裝置是來自處理器的信息的目標或接收者。處理器和目標裝置經由系統互連來通信。處理器執行或處理指令。作為指令執行的一部分,處理器確定與指令相關聯的指令操作和地址。通過處理器基于指令來確定裝飾值。裝飾值或裝飾是提供到諸如存儲器的目標裝置的信息,用于執行裝飾存儲操作。裝飾值被從處理器的通用寄存器中的存儲提供并且連同經轉換的地址傳遞到目標裝置,所述地址指示由指令執行導致的目標位置。裝飾值是到目標裝置的命令,用于除了所執行的指令的主要功能之外的功能。例如,所執行的指令可以是從目標存儲位置加載數據或將數據存儲到目標存儲位置,并且裝飾值可以是用于遞增目標位置或用于將目標位置數據乘以另一操作數的命令。應該理解,可以響應于裝飾值,由目標裝置來實現各種附加或替代的處理功能中的任一個。裝飾值通常不由處理器來解釋,并且給定的裝飾值可以根據指令的目標位置來執行需要不同訪問許可的不同操作。注意的是,不是所有的加載和存儲指令都提供裝飾值。在一個實施例中,提供了單獨的加載、存儲、帶裝飾的加載和帶裝飾的存儲指令類型。
如在此使用的,術語“總線”是一種系統互連,并且用于指代可用于傳遞諸如數據、地址、控制或狀態的一種或多種類型信息的多個信號或導體。可以參照作為單個導體、多個導體、單向導體或雙向導體來示出或描述如在此所討論的導體。然而,不同的實施例可以變化導體的實現方式。例如,可以使用單獨的單向導體而非雙向導體,反之亦然。另外,可以用串行或者以時分復用方式傳遞多個信號的單個導體來替代多個導體。同樣,攜載多個信號的單個導體可以被分成攜載這些信號的子集的各種不同導體。因此,對于傳遞信號而言,存在許多選擇。
當參照使信號、狀態位或類似設備分別為其邏輯真或邏輯假狀態時,在此使用三術語“斷言”或“設置”和“否定”(或“去斷言”或“清除”)。如果邏輯真狀態是邏輯電平1,則邏輯假狀態是邏輯電平0。并且,如果邏輯真狀態是邏輯電平0,則邏輯假狀態是邏輯電平1。
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