[實用新型]代碼完整性校驗電路有效
| 申請號： | 200920134285.2 | 申請日： | 2009-07-29 |
| 公開（公告）號： | CN201489524U | 公開（公告）日： | 2010-05-26 |
| 發明（設計）人： | 郭小強;黃洋 | 申請（專利權）人： | 深圳國微技術有限公司 |
| 主分類號： | G06F12/14 | 分類號： | G06F12/14 |
| 代理公司： | 深圳市康弘知識產權代理有限公司 44247 | 代理人： | 胡朝陽;孫潔敏 |
| 地址： | 518057 廣東省深圳市南山*** | 國省代碼： | 廣東;44 |
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| 摘要： | |||
| 搜索關鍵詞： | 代碼 完整性 校驗 電路 | ||
【權利要求書】：
1.一種代碼完整性校驗電路，其特征在于包括系統總線、閃存、實時完整性校驗單元、一次性可編程存儲器、DMA控制器及CPU，所述閃存、實時完整性校驗單元、一次性可編程存儲器、DMA控制器及CPU都連接到所述系統總線上，所述實現完整性校驗單元與所述DMA控制器相連接。
2.如權利要求1所述的代碼完整性校驗電路，其特征在于，所述實現完整性校驗單元包括算法控制模塊，算法模塊、時序控制模塊、DMA配置模塊及看門狗，所述算法控制模塊分別連接至所述算法存儲模塊、時序控制模塊、DMA配置模塊及看門狗。
3.如權利要求2所述的代碼完整性校驗電路，其特征在于，所述DMA配置模塊連接至所述DMA控制器。
4.如權利要求2所述的代碼完整性校驗電路，其特征在于，所述算法模塊包括SHA1和SHA256兩種HASH算法。
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