[發明專利]音頻編碼芯片供電電路無效
| 申請號: | 200910304964.4 | 申請日: | 2009-07-29 |
| 公開(公告)號: | CN101989116A | 公開(公告)日: | 2011-03-23 |
| 發明(設計)人: | 胡可友 | 申請(專利權)人: | 鴻富錦精密工業(深圳)有限公司;鴻海精密工業股份有限公司 |
| 主分類號: | G06F1/26 | 分類號: | G06F1/26 |
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| 地址: | 518109 廣東省深圳市*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關鍵詞: | 音頻 編碼 芯片 供電 電路 | ||
技術領域
本發明是關于一種供電電路,尤指一種可保證音頻編碼芯片正常工作的音頻編碼芯片供電電路。
背景技術
電腦上通常設有一提供音頻輸出的音頻編碼芯片,電腦主板上設有為所述音頻編碼芯片供電的供電電路。如圖1所示,現有的一種音頻編碼芯片供電電路通常由一主板電源輸出端Vo直接給音頻編碼芯片30供電。通常,在所述主板電源輸出3.3V的電源電壓Vs給音頻編碼芯片30的同時,會伴隨所述電源電壓Vs輸出一個漏電電壓Vl。所述漏電電壓Vl直接進入所述音頻編碼芯片30內的一個數模信號轉換電路31的電源輸入端ViL。所述數模信號轉換電路31判斷輸入的所述電源信號的電平值。通常,當ViL小于0.3倍的電源電壓(即門限電壓0.99V)時,所述數模信號轉換電路會判定ViL為低電平。但是,當電腦主板搭配某些型號的電源(如FSB?ATX3000-68PD電源)時,其輸出的漏電電壓可達到0.9V。由于不同的音頻編碼器判斷門限電壓的值有一定差別,所述0.9V的漏電電壓可能處于門限電壓的臨界值,在某些情況下,0.9V的漏電電壓可能高出門限值。此時,所述ViL將不被所述數模信號轉換電路31判定為低電平,因此造成音頻編碼芯片無法正常工作。
發明內容
鑒于以上內容,有必要提供一種在搭配不同電源時,音頻編碼芯片均可正常工作的音頻編碼芯片供電電路。
一種音頻編碼芯片供電電路,包括一音頻編碼芯片及為所述音頻編碼芯片供電的主板電源,所述音頻編碼芯片具有一電源輸入端,所述音頻編碼芯片的電源輸入端與所述主板電源之間連接一可降低主板電源的漏電電壓的電壓吸收電路。
優選地,所述電壓吸收電路包括一第一電容及與所述第一電容并聯的第一電阻,所述第一電容及第一電阻連接至所述主板電源。
優選地,所述電壓吸收電路還包括一與所述第一電容及第一電阻并聯的第二電阻。
優選地,所述電壓吸收電路還包括一濾波電容,所述第一電容、第一電阻、及第二電阻并聯后與所述濾波電容一端相連,所述濾波電容另一端接地。
優選地,所述主板電源為3.3伏特。
優選地,所述第一電容及濾波電容的容值為4.7微法,所述第一電阻及第二電阻的阻值為30歐姆。
優選地,所述電壓吸收電路將所述主板電源的漏電電壓由0.9伏特降低至0.3伏特。
與現有技術相比,上述音頻編碼芯片供電電路在主板電源及音頻編碼芯片之間增加了一個電壓吸收電路,從而降低伴隨主板電源輸出的漏電電壓,使所述音頻編碼芯片可正常工作。
附圖說明
下面參照附圖結合實施例對本發明作進一步的描述。
圖1是現有技術中音頻編碼芯片供電電路的電路圖。
圖2是本發明音頻編碼芯片供電電路的方框圖。
圖3是本發明音頻編碼芯片供電電路的具體電路圖。
具體實施方式
請參閱圖2,本發明音頻編碼芯片供電電路包括一主板電源10及一音頻編碼芯片30。所述音頻編碼芯片30具有一電源輸入端Vd,并包括一數模信號轉換電路31。所述數模信號轉換電路31具有一信號輸入端ViL。所述數模信號轉換電路31可判斷所述信號輸入端ViL輸入的信號是低電平或高電平。當所述輸入的ViL為低電平時,所述音頻編碼芯片30可正常工作。本發明音頻編碼芯片供電電路還包括一連接在所述主板電源10與所述音頻編碼芯片30的電源輸入端Vd之間的電壓吸收電路50。
請同時參閱圖3,所述主板電源10具有一輸出電壓為3.3V的輸出端Vo。所述電壓吸收電路50包括一第一電容C1,一第一電阻R1,一第二電阻R2,及一濾波電容C2。所述第一電阻R1,第二電阻R2,及所述第一電容C1并聯后一端與所述主板電源10的輸入端Vo相連,另一端與所述音頻編碼芯片30的電源輸入端Vd及信號輸入端ViL相連,并同時與所述濾波電容C2一端相連。所述濾波電容C2的另一端接地。在本實施方式中,所述第一電容C1及濾波電容C2的容值為4.7微法;所述第一電阻R1及第二電阻R2的阻值為30歐姆。
當所述主板電源10上電時,所述主板電源10的輸出端Vo輸出一3.3V的直流電源電壓Vs,并同時伴隨著漏電電壓Vl。所述3.3V的電源電壓Vs為音頻編碼芯片30提供工作電壓。所述電源電壓Vs及漏電電壓Vl通過所述電壓吸收電路50后輸入至所述音頻編碼芯片30的電源輸入端Vd及所述數模信號轉換電路31的信號輸入端ViL。所述電源電壓Vs及漏電電壓Vl通過所述電壓吸收電路50后電壓降低。
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