[發明專利]通過存儲器地址映射使處理器與外部設備相接口的橋電路有效
| 申請號: | 200880123203.2 | 申請日: | 2008-12-23 |
| 公開(公告)號: | CN101911035A | 公開(公告)日: | 2010-12-08 |
| 發明(設計)人: | 松本宗久;九野信一郎 | 申請(專利權)人: | 馬維爾國際貿易有限公司 |
| 主分類號: | G06F13/40 | 分類號: | G06F13/40 |
| 代理公司: | 北京東方億思知識產權代理有限責任公司 11258 | 代理人: | 宋鶴;南霆 |
| 地址: | 巴巴多斯*** | 國省代碼: | 巴巴多斯;BB |
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| 摘要: | |||
| 搜索關鍵詞: | 通過 存儲器 地址 映射 處理器 外部設備 相接 電路 | ||
1.一種橋電路,包括:
總線;
存儲器接口模塊,所述存儲器接口模塊經由存儲器接口從處理器接收存儲器地址,并且將所述存儲器地址輸出到所述總線,其中所述存儲器地址與所述處理器的地址空間的多個地址區域中的一個相對應;
存儲器控制模塊,所述存儲器控制模塊經由所述總線接收所述存儲器地址,并且當所述存儲器地址與所述多個地址區域中的第一地址區域相對應時與存儲器通信;以及
外部存儲控制模塊,所述外部存儲控制模塊經由所述總線接收所述存儲器地址,并且當所述存儲器地址與所述多個地址區域中的第二地址區域相對應時與外部存儲設備通信。
2.如權利要求1所述的橋電路,還包括所述存儲器。
3.如權利要求2所述的橋電路,其中所述存儲器包括動態隨機存取存儲器(DRAM)、同步DRAM(SDRAM)和雙倍數據速率DRAM(DDR)中的至少一個。
4.如權利要求1所述的橋電路,還包括外圍設備控制模塊,所述外圍設備控制模塊經由所述總線接收所述存儲器地址,并且當所述存儲器地址與所述多個地址區域中的第三地址區域相對應時與外圍設備通信。
5.如權利要求1所述的橋電路,還包括外部存儲接口,所述外部存儲接口將所述外部存儲控制模塊與所述外部存儲設備相接口。
6.如權利要求5所述的橋電路,其中所述外部存儲接口包括高級技術附件(ATA)接口、串行ATA(SATA)接口、高級技術附件包接口(ATAPI)、消費者電子ATA(CE-ATA)接口、個人計算機存儲卡國際協會(PCMCIA)接口以及小型計算機系統接口(SCSI)中的至少一個。
7.如權利要求4所述的橋電路,還包括外圍設備接口,所述外圍設備接口將所述外圍設備控制模塊與所述外圍設備相接口。
8.如權利要求7所述的橋電路,其中所述外圍設備接口包括通用串行總線(USB)接口。
9.如權利要求1所述的橋電路,其中所述存儲器接口包括動態隨機存取存儲器(DRAM)接口。
10.如權利要求1所述的橋電路,其中所述外部存儲設備包括磁存儲設備和光存儲設備中的至少一個。
11.如權利要求1所述的橋電路,其中所述外部存儲設備經由所述總線與所述存儲器通信。
12.如權利要求4所述的橋電路,其中所述外圍設備經由所述總線與所述存儲器通信。
13.一種消費者電子(CE)設備,包括如權利要求1所述的橋電路,并且還包括控制模塊,所述控制模塊包括所述處理器,經由所述存儲器接口與所述存儲器接口模塊通信,并且經由所述存儲器接口模塊而與所述存儲器和所述外部存儲設備通信。
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