[發(fā)明專利]包括環(huán)形緩沖器的裝置和用于向環(huán)形緩沖器分配冗余版本的方法有效
| 申請(qǐng)?zhí)枺?/td> | 200880019982.1 | 申請(qǐng)日: | 2008-06-17 |
| 公開(公告)號(hào): | CN101682486A | 公開(公告)日: | 2010-03-24 |
| 發(fā)明(設(shè)計(jì))人: | 宇菲·W·布蘭肯希普;T·基思·布蘭肯希普;布賴恩·K·克拉松;阿吉特·尼姆巴爾克 | 申請(qǐng)(專利權(quán))人: | 摩托羅拉公司 |
| 主分類號(hào): | H04L1/18 | 分類號(hào): | H04L1/18 |
| 代理公司: | 中原信達(dá)知識(shí)產(chǎn)權(quán)代理有限責(zé)任公司 | 代理人: | 穆德駿;陸錦華 |
| 地址: | 美國(guó)伊*** | 國(guó)省代碼: | 美國(guó);US |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 包括 環(huán)形 緩沖器 裝置 用于 分配 冗余 版本 方法 | ||
1.一種用于將冗余版本分配至環(huán)形緩沖器的方法,所述方法包括 下述步驟:
接收系統(tǒng)比特、第一奇偶比特塊和第二奇偶比特塊,其中,所述 系統(tǒng)比特、所述第一奇偶比特塊和所述第二奇偶比特塊均包括虛比特;
單獨(dú)地對(duì)所述系統(tǒng)比特、第一奇偶比特塊和第二奇偶比特塊進(jìn)行 塊交織;
將所述第一奇偶比特塊與所述第二奇偶比特塊進(jìn)行交錯(cuò),以創(chuàng)建 交錯(cuò)的奇偶比特;
將所述交織的系統(tǒng)比特添加到所述交錯(cuò)的奇偶比特前面,以創(chuàng)建 環(huán)形緩沖器;
從所述環(huán)形緩沖器中刪除一個(gè)或多個(gè)列,以形成縮短的環(huán)形緩沖 器;
將冗余版本定義為開始于所述縮短的環(huán)形緩沖器的特定行;
接收冗余版本以及期望比特的數(shù)目;以及
輸出開始于所述冗余版本比特位置的所述數(shù)目的期望比特。
2.根據(jù)權(quán)利要求1所述的方法,進(jìn)一步包括下述步驟,
將所述冗余版本定義為開始于所述縮短的環(huán)形緩沖器的列頂部。
3.根據(jù)權(quán)利要求2所述的方法,其中,所述將冗余版本定義為開 始于所述縮短的環(huán)形緩沖器的列頂部的步驟包括將冗余版本定義為開 始于所述縮短的環(huán)形緩沖器的八個(gè)列頂部的步驟。
4.根據(jù)權(quán)利要求2所述的方法,其中,所述將冗余版本定義為開 始于所述縮短的環(huán)形緩沖器的列頂部的步驟包括將冗余版本定義為開 始于所述縮短的環(huán)形緩沖器的四個(gè)列頂部的步驟。
5.根據(jù)權(quán)利要求2所述的方法,進(jìn)一步包括下述步驟,
將第一冗余版本定義為開始于第σ列的頂部,其中,σ是偏移列的 數(shù)目。
6.根據(jù)權(quán)利要求2所述的方法,進(jìn)一步包括下述步驟,
通過將第一冗余版本定義為開始于具有相對(duì)于所述縮短的環(huán)形緩 沖器開端的偏移的位置,來對(duì)系統(tǒng)比特進(jìn)行打孔。
7.根據(jù)權(quán)利要求1所述的方法,其中所述輸出開始于冗余版本位 置的比特的步驟包括在早于環(huán)形緩沖器末端的點(diǎn)繞回到環(huán)形緩沖器開 端。
8.根據(jù)權(quán)利要求1所述的方法,其中所述刪除一個(gè)或多個(gè)列的步 驟包括從環(huán)形緩沖器的最后一列刪除列。
9.根據(jù)權(quán)利要求1所述的方法,其中所述刪除一個(gè)或多個(gè)列的步 驟包括基于floor(NIR/C)確定每段的緩沖器大小,其中,C是用于串 接傳輸塊的段的碼字的數(shù)目,通過碼塊分割規(guī)則被確定,并且其中, NIR是每混合自動(dòng)重復(fù)請(qǐng)求過程的總軟緩沖器大小。
10.一種用于將冗余版本分配至傳輸塊的環(huán)形緩沖器的裝置,包 括:
編碼器,所述編碼器輸出系統(tǒng)比特、第一奇偶比特塊和第二奇偶 比特塊;
速率匹配電路,所述速率匹配電路接收所述系統(tǒng)比特、第一奇偶 比特塊和第二奇偶比特塊,并且創(chuàng)建具有虛比特的環(huán)形緩沖器,并且 其中,所述環(huán)形緩沖器的特定行包含冗余版本(RV)的開始點(diǎn),并且 其中,所述速率匹配電路從所述環(huán)形緩沖器中刪除一個(gè)或多個(gè)列,以 形成縮短的環(huán)形緩沖器,并且其中,所述速率匹配電路從特定冗余版 本開始將非虛比特從所述縮短的環(huán)形緩沖器輸出至發(fā)射器;
發(fā)射電路,所述發(fā)射電路接收所述非虛比特并且發(fā)射所述非虛比 特。
11.根據(jù)權(quán)利要求10所述的裝置,其中,所述縮短的環(huán)形緩沖器 的八個(gè)列頂部被定義為冗余版本的開始位置。
12.根據(jù)權(quán)利要求10所述的裝置,其中,所述縮短的環(huán)形緩沖器 的四個(gè)列頂部被定義為用于冗余版本的開始位置。
13.根據(jù)權(quán)利要求10所述的裝置,其中,所述縮短的環(huán)形緩沖器 包括交織的系統(tǒng)比特、交織和交錯(cuò)的第一和第二奇偶比特塊。
14.根據(jù)權(quán)利要求10所述的裝置,其中,所述速率匹配電路在第σ 列的頂部開始第一冗余版本,其中,σ是偏移列的數(shù)目。
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