[發明專利]用于進行時間測量的EEPROM電荷保持電路無效
| 申請號： | 200780036005.8 | 申請日： | 2007-07-20 |
| 公開（公告）號： | CN101601096A | 公開（公告）日： | 2009-12-09 |
| 發明（設計）人： | 弗蘭西斯科·拉·羅薩 | 申請（專利權）人： | 意法半導體有限公司 |
| 主分類號： | G11C16/04 | 分類號： | G11C16/04;G11C16/26;G11C16/22 |
| 代理公司： | 北京安信方達知識產權代理有限公司 | 代理人： | 韓 龍;閻娬斌 |
| 地址： | 法國*** | 國省代碼： | 法國;FR |
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| 摘要： | |||
| 搜索關鍵詞： | 用于 進行 時間 測量 eeprom 電荷 保持 電路 | ||
1.一種用于時間測量的電荷保持電子電路，被嵌入到EEPROM型存儲器單元網絡中，在相同的存儲單元行中，每個單元都包括與浮柵晶體管串聯的選擇晶體管，包括：
至少一個第一單元(C1)的第一子集，其浮柵晶體管的隧道窗口的電介質(112)的厚度比其他單元的薄；
至少一個第二單元(C2)的第二子集，其浮柵晶體管的漏極和源極互連；
至少一個第三單元(7)的第三子集；以及
至少一個第四單元(6)的第四子集，其隧道窗口被去除，這四個子集的單元的晶體管的相應浮動柵極被互連。
2.如權利要求1所述的電路，其中單元的位線(BL1，BL2，BL3，BL4)可通過子集來尋址。
3.如權利要求1或2所述的電路，其中四個子集的單元的選擇晶體管(T1，T2，T3，T4)的控制端子被互連到向電路施加選擇信號(SEL)的端子上。
4.如權利要求1到3中任一個所述的電路，其中第一子集的單元(C1)數目決定了電荷損失速率。
5.如權利要求1到4中任一個所述的電路，其中第二子集的單元(C2)數目決定了保持時間。
6.如權利要求1到5中任一個所述的電路，其中第三子集的單元(7)的數目決定了復位或編程速率。
7.如權利要求1到6中任一個所述的電路，其中第四子集的單元數目決定了測量電流。
8.一種用于控制權利要求1到7任何一個所述的電路的方法，其中將編程或者復位電壓施加在第三子集的位線上。
9.根據權利要求8所述的方法，其中讀取電壓施加在第四子集的位線上，而所有的其他位線處于高阻態，從而使用與浮動節點(F)上的殘留電荷成比例的數據。
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