[實用新型]視頻目標發生器無效
| 申請號: | 200720015581.1 | 申請日: | 2007-10-31 |
| 公開(公告)號: | CN201114519Y | 公開(公告)日: | 2008-09-10 |
| 發明(設計)人: | 張帆;佟新鑫;王旭;栗霄峰 | 申請(專利權)人: | 中國科學院沈陽自動化研究所 |
| 主分類號: | H04N7/18 | 分類號: | H04N7/18;G06T7/00 |
| 代理公司: | 沈陽科苑專利商標代理有限公司 | 代理人: | 許宗富;周秀梅 |
| 地址: | 110016遼寧*** | 國省代碼: | 遼寧;21 |
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| 摘要: | |||
| 搜索關鍵詞: | 視頻 目標 發生器 | ||
1.一種視頻目標發生器,其特征包括:
主控模塊(MCU),通過串行通訊接口與上位機信息交互,通過數據總線與視頻信號產生模塊相連;并與目標信息疊加模塊通信;
視頻信號產生模塊,輸出不同制式的視頻信號分量經過驅動電路至目標信息疊加模塊的輸入端;
目標信息疊加模塊,由現場可編程邏輯門陣列(FPGA)和視頻疊加模塊構成,現場可編程邏輯門陣列(FPGA)以行場消隱信號或同步信號作為時序基礎,生成的目標信息送至視頻疊加模塊;視頻疊加模塊接收復合同步信號,生成的目標視頻信息輸出至外圍電路,作為待檢測設備的視頻輸入。
2.根據權利要求1所述視頻目標發生器,其特征是:視頻信號產生模塊輸出的制式包括PAL、NTSC或SECAM;視頻信號分量包括行場同步信號、行場消隱信號、復合同步信號。
3.根據權利要求1所述視頻目標發生器,其特征是:可編程邏輯門陣列(FPGA)由I2C數據存取模塊、字符信息生成模塊、目標信息生成模塊、數據通訊控制模塊組成,I2C數據存取模塊通過I2C控制總線接收來自主控模塊(MCU)的控制信息,將所述控制信息送至字符信息生成模塊;目標信息生成模塊以行場消隱信號為時序基礎,生成的目標信息及自檢信號結合字符信息分別送至視頻疊加模塊和主控模塊;數據通訊控制模塊的輸出一方面給主控模塊,另一方面接至跟蹤系統。
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