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[發明專利]使用用于存儲裝置通信和點對點通信的單一集成電路在數據存儲系統中提供通信的技術無效

專利信息
申請號: 200680023154.6 申請日: 2006-03-27
公開(公告)號: CN101208673A 公開(公告)日: 2008-06-25
發明(設計)人: 約翰·V.·伯勒斯;馬修·朗 申請(專利權)人: 伊姆西公司
主分類號: G06F13/16 分類號: G06F13/16
代理公司: 北京金信立方知識產權代理有限公司 代理人: 黃威
地址: 美國馬*** 國省代碼: 美國;US
權利要求書: 查看更多 說明書: 查看更多
摘要:
搜索關鍵詞: 使用 用于 存儲 裝置 通信 點對點 單一 集成電路 數據 存儲系統 提供 技術
【說明書】:

背景技術

典型的數據存儲系統包括存儲處理電路和磁盤驅動器陣列。存儲處理電路代表外部主計算機將數據存儲到磁盤驅動器陣列中或從磁盤驅動器陣列取回數據。在一些傳統的數據存儲系統中,存儲處理電路包括串行ATA(SATA)接口集成電路(IC),其使用SATA協議與磁盤驅動器陣列通信。SATA集成電路通過向磁盤驅動器陣列提供SATA命令使存儲處理電路用作SATA的發起方。磁盤驅動器陣列通過響應SATA命令用作一組SATA目標(例如響應SATA命令讀和寫數據)。

一個傳統的數據存儲系統包括兩個高性能的存儲處理器。每一個存儲處理器包括各自的SATA集成電路,集成電路具有用于每一個磁盤驅動器的接收端口和發送端口。因此,如果一個存儲處理器出現故障,另一個存儲處理器可以訪問每一個磁盤驅動器并嘗試繼續運轉。

在上述傳統數據存儲系統中,每一個存儲處理器進一步包括并行總線元件,其獨立于該存儲處理器的SATA集成電路。每一個存儲處理器的直接存儲器存取(DMA)引擎通過并行總線元件進行基于DMA的存儲和取回操作以在存儲處理器之間形成緩存鏡像接口(CMI)。因此,每一個存儲處理器能夠在其他存儲處理器的高速緩沖存儲器中鏡像數據。在高速緩沖存儲器中鏡像數據,存儲處理器能夠運行在改進響應時間的回寫模式(即當數據鏡像在兩個高速緩沖存儲器中時,存儲處理器就能夠完全投入數據存儲運行,因為即使一個存儲處理器出現故障,數據仍然可用)。

各種SATA規范的進一步的細節可以在名稱為“串行ATA?II:電規范”(版本1.0,2004年5月26日)的文件中查找到,通過引用在此結合其全部內容。

發明內容

遺憾的是,使用SATA集成電路與磁盤驅動器陣列通信和使用并行總線元件相互通信的上述存儲處理器有一些缺點。例如,使用SATA集成電路進行磁盤驅動器通信和使用獨立的并行總線元件進行CMI通路通信不能高效利用印刷電路板(PCB)的資源。具體地,這些獨立的電路板組件需要各自的安裝位置、臨近的支撐電路以及用于通向和來自這些安裝位置與支撐電路的信號跡線的空間。此外,由于存儲處理器通過并行總線元件(即用于緩存鏡像)執行DMA操作,必須采取額外的設計預防措施防止存儲處理器之一故障,鎖定仍在運行的存儲處理器的并行總線元件,進而掛起仍在運行的存儲處理器。

上述傳統的數據存儲系統使用的存儲處理器具有用于SATA磁盤驅動器通信的獨立SATA集成電路和用于基于DMA的CMI路徑通信的并行總線元件,與上述傳統的數據存儲系統相比,改進的技術利用具有用于存儲裝置通信的第一組端口和用于點對點存儲處理器通信的第二組端口的封裝IC器件。即,當單一IC適當地配置在存儲處理器上時,該單一IC能夠用作(i)存儲裝置(例如,用于同步高速緩沖存儲器與磁盤驅動器存儲器)和(ii)另一存儲處理器(例如,用于在存儲處理器之間進行緩存鏡像)的接口。這樣的技術節省PCB的基板面,以及緩解在存儲處理器之間需要提供基于并行總線DMA的通信的需求。

一個實施例致力于數據存儲系統,數據存儲系統具有存儲裝置組、用于代表外部主計算機組將數據存儲到存儲裝置組和從存儲裝置組取回數據的第一存儲處理器與第二存儲處理器。第一存儲處理器包括處理電路和具有第一組端口與第二組端口的封裝IC器件。處理電路適于配置封裝IC器件以提供(i)通過第一組端口與存儲裝置組的通信和(ii)通過第二組端口與第二存儲處理器的其他通信。處理電路進一步適于通過封裝IC器件的第一組端口在第一存儲處理器與存儲裝置組之間傳遞通信;及通過封裝IC器件的第二組端口在第一存儲處理器與第二存儲處理器之間傳遞通信。這樣的實施例非常高效地利用電路板資源,以及在數據存儲系統內提供堅固通信(例如,SATA、串行連接SCSI、光纖通路)。

附圖說明

本發明的上述和其他目標、特征和優點將從以下本發明的具體實施例的說明中明顯看出,如附圖中所示,在所有視圖中相同的附圖標記指代相同的部件。附圖不是限定本發明的范圍,重點在于說明本發明的原理。

圖1是具有用于存儲裝置通信和點對點存儲處理器通信的封裝IC器件的數據存儲系統的框圖。

圖2是說明圖1的數據存儲系統的存儲處理器運行的框圖。

圖3是進一步說明圖1的數據存儲系統的存儲處理器運行的框圖。

圖4是處理電路執行的程序的流程圖,處理電路屬于圖1的數據存儲系統的存儲處理器之一。

具體實施方式

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