[發(fā)明專利]帶有流中數(shù)據(jù)加密/解密和糾錯的存儲器系統(tǒng)有效
| 申請?zhí)枺?/td> | 200580048438.6 | 申請日: | 2005-12-21 |
| 公開(公告)號: | CN101124545A | 公開(公告)日: | 2008-02-13 |
| 發(fā)明(設(shè)計)人: | 邁克爾·霍爾茨曼;巴魯赫·B·科亨;穆罕默德·R·伊斯蘭;馬修·戴維森 | 申請(專利權(quán))人: | 桑迪士克股份有限公司 |
| 主分類號: | G06F11/10 | 分類號: | G06F11/10;G06F12/14 |
| 代理公司: | 北京律盟知識產(chǎn)權(quán)代理有限責(zé)任公司 | 代理人: | 劉國偉 |
| 地址: | 美國加利*** | 國省代碼: | 美國;US |
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| 摘要: | |||
| 搜索關(guān)鍵詞: | 帶有 數(shù)據(jù) 加密 解密 糾錯 存儲器 系統(tǒng) | ||
1.一種用于糾正存儲器系統(tǒng)中的數(shù)據(jù)的方法,所述存儲器系統(tǒng)包含非易失性存儲單元和密碼化電路且用于存儲經(jīng)加密數(shù)據(jù),所述方法包括:
使用所述電路對來自或到達(dá)所述單元的數(shù)據(jù)流中的數(shù)據(jù)執(zhí)行密碼化處理;
提供至少一個緩沖器來存儲在所述單元與所述電路的之間傳遞的數(shù)據(jù)流中的數(shù)據(jù);以及
在所述電路對存儲在所述緩沖器中且源自所述單元的所述數(shù)據(jù)執(zhí)行密碼化處理之前,糾正所述數(shù)據(jù)中的任何錯誤。
2.根據(jù)權(quán)利要求1所述的方法,其中所述糾正是響應(yīng)于指示來自所述單元并去往所述電路的所述數(shù)據(jù)流中的數(shù)據(jù)存在一個或多個錯誤的信號,使得所述糾正在所述數(shù)據(jù)到達(dá)所述電路之前糾正所述一個或多個錯誤。
3.根據(jù)權(quán)利要求2所述的方法,所述系統(tǒng)包括兩個緩沖器,其用于存儲在所述單元與所述電路之間傳遞的所述數(shù)據(jù)流中的數(shù)據(jù),所述方法進一步包括:使用所述兩個緩沖器來交替地存儲數(shù)據(jù)和將所述數(shù)據(jù)從所述單元發(fā)送到所述電路。
4.根據(jù)權(quán)利要求3所述的方法,其中當(dāng)向所述電路發(fā)送存儲在所述兩個緩沖器中的第二緩沖器中的數(shù)據(jù)時,所述使用存儲所述兩個緩沖器中的第一緩沖區(qū)中的數(shù)據(jù)。
5.一種用于存儲經(jīng)加密數(shù)據(jù)的存儲器系統(tǒng),其包括:
非易失性存儲單元;
電路,其對來自或到達(dá)所述單元的數(shù)據(jù)流中的數(shù)據(jù)執(zhí)行密碼化處理;
至少一個緩沖器,其用于存儲在所述單元與所述電路之間傳遞的數(shù)據(jù)流中的數(shù)據(jù);以及
控制器,其用于控制所述單元、所述至少一個緩沖器和所述電路,以在所述電路對存儲在所述緩沖器中且源自所述單元的所述數(shù)據(jù)執(zhí)行密碼化處理之前糾正所述數(shù)據(jù)中的任何錯誤。
6.根據(jù)權(quán)利要求5所述的系統(tǒng),其中所述控制器響應(yīng)于指示來自所述單元并去往所述電路的所述數(shù)據(jù)流中的數(shù)據(jù)存在一個或多個錯誤的信號,并在所述數(shù)據(jù)到達(dá)所述電路之前糾正所述一個或多個錯誤。
7.根據(jù)權(quán)利要求6所述的系統(tǒng),其進一步包括糾錯電路,其檢測所述數(shù)據(jù)流中的錯誤,并當(dāng)檢測到所述數(shù)據(jù)流中的至少一個錯誤時使所述信號被發(fā)送到所述控制器。
8.根據(jù)權(quán)利要求5所述的系統(tǒng),所述系統(tǒng)包括兩個緩沖器,其用于存儲在所述單元與所述電路之間傳遞的所述數(shù)據(jù)流中的數(shù)據(jù),其中所述兩個緩沖器用于交替地存儲數(shù)據(jù)和將所述數(shù)據(jù)從所述單元發(fā)送到所述電路。
9.根據(jù)權(quán)利要求8所述的系統(tǒng),其中當(dāng)向所述電路發(fā)送存儲在所述兩個緩沖器中的第二緩沖器中的數(shù)據(jù)時,數(shù)據(jù)正存儲在所述兩個緩沖器中的第一緩沖區(qū)中。
10.根據(jù)權(quán)利要求5所述的系統(tǒng),其中所述控制器使所述數(shù)據(jù)流中的數(shù)據(jù)以旁路模式繞過交替的旁路路徑中的所述緩沖器和所述電路。
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