[發(fā)明專利]帶排出臺(tái)的可變?nèi)軫IFO存放裝置無(wú)效
| 申請(qǐng)?zhí)枺?/td> | 200510051111.6 | 申請(qǐng)日： | 2005-02-28 |
| 公開（公告）號(hào)： | CN1659986A | 公開（公告）日： | 2005-08-31 |
| 發(fā)明（設(shè)計(jì)）人： | 米凱萊·費(fèi)拉里;紹羅·烏切拉里;亞歷山德羅·米納雷利 | 申請(qǐng)（專利權(quán)）人： | 吉第聯(lián)合股份公司 |
| 主分類號(hào)： | A24C5/35 | 分類號(hào)： | A24C5/35;B65G21/16 |
| 代理公司： | 北京康信知識(shí)產(chǎn)權(quán)代理有限責(zé)任公司 | 代理人： | 章社杲;吳貴明 |
| 地址： | 意大利*** | 國(guó)省代碼： | 意大利;IT |
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| 摘要： | |||
| 搜索關(guān)鍵詞： | 出臺(tái) 可變 fifo 存放 裝置 | ||
【說(shuō)明書】：
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- 數(shù)據(jù)緩存器溢出的自動(dòng)解除方法和裝置
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- 一種異步FIFO控制器及防止異步FIFO緩存數(shù)據(jù)溢出的方法
- 一種異步fifo實(shí)現(xiàn)電路
- 一種基于FPGA的級(jí)聯(lián)FIFO模塊的設(shè)計(jì)方法
- 一種異步數(shù)據(jù)傳輸方法和結(jié)構(gòu)
- 一種FIFO master接口、具有該接口的FPGA及應(yīng)用
