[其他]地址控制裝置在審
| 申請號: | 101985000001164 | 申請日: | 1985-04-01 |
| 公開(公告)號: | CN1004945B | 公開(公告)日: | 1989-08-02 |
| 發明(設計)人: | 中野嘉博 | 申請(專利權)人: | 國際商業機器公司 |
| 主分類號: | 分類號: | ||
| 代理公司: | 中國國際貿易促進委員會專利代理部 | 代理人: | 趙越;李勇 |
| 地址: | 美國紐約*** | 國省代碼: | 暫無信息 |
| 權利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關鍵詞: | 地址 控制 裝置 | ||
一種裝置,用于在一系統如微型計算機中控制存儲器的地址分配。其中包括一選擇裝置,該選擇裝置可以選中現有基本存儲器和新的擴展的存儲器中的一塊,從而當系統使用擴展的CPU來擴展地址空間時,可在原具有一定地址線端的基本存儲器上加一具有更多地址線端的擴展存儲器,使得原有基本存儲器可在該擴展系統中繼續使用。
本發明涉及在微型計算機等系統中控制存儲器的地址分配的裝置,特別是涉及用于擴展地址總線的地址控制裝置。
如圖1所示的一微型計算機系統,一般有一個中央處理器CPU1和一個存儲器M1(在本說明書中,假設該存儲器M1包括多個連接在地址總線上的存儲器,以及多個已被分配了存儲地址的輸入/輸出接口)。存儲器M1有許多可指定存儲位置的地址。CPU1通過由多條地址線(如20條線)組成的地址總線1在存儲器M1中的指定位置上進行存取;并且通過發送控制信號從M1中讀出數據,例如,通過控制線3向存儲器M1發送一個低電平讀控制信號;另一方面,通過發送信號信號向存儲器M1寫入數據,如通過控制線4向存儲器M1發送一個低電平寫控制信號。應當注意所用的CPU具有固定數目地址線,并且由CPU控制能存取到的存儲空間是由上述地址線的條數來決定的。例如,有20條地址線,那么就會有220=1,048,576個地址能被單獨分配。這就意味著可以利用的存儲空間高達1兆字節。
近年來,具有很大地址空間,或具有增大地址線數目的所謂擴展兼容的CPU已經在市場上出售??墒?,如果用一擴展兼容的CPU來替換現有產品中所用的CPU從而使現有產品的功能得到改善,當老產品和新產品連接時,就會不可避免地出現下列問題。例如,如現有CPU具有20條地址線和1兆字節的存儲空間,而擴展兼容的CPU有24條地址線和16兆字節的存儲空間,最好是擴展具有20條地址線端的現有存儲器,使其存儲空間擴展到16兆字節,以便減少更換CPU所需的設計更改,可是,當具有20條地址線端的存儲器通過24條地址線存取數據時,由于每一存儲器不能識別在另外4條地址線上的信號,則CPU不能正常地存取存儲器中的數據。另外方面,如果所有的存儲器都被換成具有24條地址線端的存儲器,則現有的具有20條地址線端的存儲器就無法使用。因而形成了資源浪費。而且,將需要較大的設計更改,由于設計費用太大,而使設計人員放棄這種設計更改。
歐州專利EP-B1-0028312公開了具有不同存儲容量的存儲裝置101、103、104、106和107,它們被安裝在同樣的數據處理系統中,然而,101、103、104、106和107所有這些存儲裝置都具有同樣12個地址線端(包括裝置103、104和106的ME2端),來自處理器的12個最小有效地址連接到所有這些存儲裝置(101、103、104、106和107)上,未把存儲裝置直接連接到來自該處理器的4個最高有效地址線上。因此,EP-B1-0028312不能像本發明那樣,把具有不同地址線端的存儲裝置安裝在同一數據處理系統中,并且通過處理器可適當地進行讀和寫。
日本公開的未審查專利申請NO.55-52163公開了一個數據處理系統,在此中通過處理器設定一個存儲器指定寄存器來增加來自處理器的地址線數目,以增加可尋址的存儲空間。然而,NO.55-52163日本專利申請公開的處理器具有的地址少于擴展的存儲空間。因此,NO.55-52163日本專利申請不是像本發明那樣,使得比老處理器的地址線多的處理器能用于比較少地址線數的為老處理器的數據處理系統所設計的存儲裝置上。
本發明的目的是,通過使用具有和擴展前一樣地址線端的存儲器來實現所謂擴展兼容的CPUs的兼容性。
根據本發明,把經擴展的第二存儲器(如具有24條地址線端)加到第一存儲器(例如,具有20條地址線端),把這些存儲器均連在一地址總線上(例如,有24條線),用20條地址線來指定第一存儲器的地址,用24條地址線來指定第二存儲器的地址。
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