[發明專利]用于CD-MP3播放裝置的集成電路及其省電方法無效
| 申請號: | 01116150.7 | 申請日: | 2001-05-17 |
| 公開(公告)號: | CN1387188A | 公開(公告)日: | 2002-12-25 |
| 發明(設計)人: | 陳政祺 | 申請(專利權)人: | 緯達電子科技股份有限公司 |
| 主分類號: | G11B20/10 | 分類號: | G11B20/10 |
| 代理公司: | 北京三友知識產權代理有限公司 | 代理人: | 穆魁良 |
| 地址: | 臺灣省*** | 國省代碼: | 臺灣;71 |
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| 摘要: | |||
| 搜索關鍵詞: | 用于 cd mp3 播放 裝置 集成電路 及其 方法 | ||
本發明涉及CD-MP3播放裝置的改進,尤其是一種用于CD-MP3播放裝置的集成電路及其省電方法。
現有技術的可讀取MP3等音樂壓縮格式的CD播放機,其所需IC及回路零件較多;請參閱圖1,為現有技術的可讀取MP3的CD播放機的系統結構圖;如圖所示,CD讀取機構1’與射頻放大器2’相連接,數字信號處理器8’分別與射頻放大器2’、MP3解碼器315’、促動器或傳動器的驅動回路7’、系統微控制器320’及電子防震緩沖儲存器4’相連接;音頻數字至模擬轉換器316’與MP3解碼器315’相連接;系統微控制器320’與外部程序儲存器5’、VFD或LCD的驅動回路6’及促動器與傳動器的驅動回路7’相連接;VFD或LCD的驅動回路6’與VFD或LCD顯示器62’相連接,促動器與傳動器的驅動回路7’與CD讀取機構l’相連接;CD讀取機構1’讀取碟片上的資料,將信號傳輸至射頻放大器2’;射頻放大器2’將已放大過后的信號傳至數字信號處理器8’;MP3解碼器315’可將MP3資料解碼壓縮,再將信號傳至音頻數字至模擬轉換器316’中;音頻數字至模擬轉換器316’將數字信號轉換成模擬信號后便可輸出;電子防震緩沖儲存器4’可暫存防震時所需的資料;系統微控制器320’可接收數字信號處理器8’的溝通信號,并將控制及顯示信號分別傳輸至促動器與傳動器的驅動回路7’及VFD或LCD顯示器的驅動回路6’,如此可控制CD讀取機構1’及VFD或LCD顯示器62’。
所以,現有技術的可讀取MP3音樂格式的CD播放器依系統功能規劃,將需要7-9顆IC來完成系統設計,如此需要的回路零件數目多,將使得該播放器的體積增大且增加故障率,造成維修不易。
再者,現有技術的可播放MP3音樂格式的CD播放機,在該播放機讀取播放MP3音樂格式的CD片時,因為系統為傳統CD播放機結構,因此驅動光碟片運轉的主軸傳動器及伺服系統,會依據播放一般CD片時的運轉速度持續運轉,無法利用MP3壓縮音樂資料的特性,如此不但會耗費電力,而且又無法降低傳動器運轉所產生的噪音。
為克服上述現有技術的CD播放機中存在的缺陷,特提出本發明的一種用于CD-MP3播放裝置的集成電路及其省電方法,其目的在于它不僅能降低該可播放MP3音樂格式的CD播放機所需的IC及回路零件數目,還可降低傳動器運轉所產生的噪音,又可在播放MP3音樂格式時,可以有較省電的模式。
本發明的用于CD-MP3播放裝置的集成電路,主要是將MP3解碼核心、光碟資料處理核心、光碟機伺服控制核心、系統微處理核心及音頻數字至模擬轉換核心等整合至該CD-MP3單晶片集成電路中,將該播放機系統所需的IC及回路零件數目降低,以縮小系統體積及降低系統總成本。
本發明的用于CD-MP3播放裝置的省電方法,主要是在該CD-MP3單晶片集成電路中,植入新開發的電源模態控制回路,借由MP3可將資料量壓縮達至十分之一以下的特性,使得該播放機在讀取MP3碟片時,可將電源模態控制回路切換為降速控制技術模態、間歇式伺服控制技術模態、暫存記憶控制技術模態等數種新開發控制模態之一,并可機動調降伺服解碼等IC內部各運作單元的運作時基頻率。
應用本發明的用于CD-MP3播放裝置的集成電路及其省電方法,其有益效果是顯而易見的:首先將CD播放機系統所需的IC及回路零件數目降低,以縮小系統體積及降低系統總成本;再者,不僅降低了主軸傳動器的運轉電流及其所產生的噪音,亦可降低CD-MP3單晶片集成電路本身的消耗電量,善用每一份能源,而達到超省電的目的。
以下為本發明的附圖:圖1為現有技術的可讀取MP3的CD播放機系統結構圖;圖2為本發明一較佳實施例應用于播放機的系統結構圖;圖3為本發明的一較佳實施例的方塊示意圖;圖4為本發明的一較佳實施例的IC內部電路方塊圖。
下面結合附圖對本發明做進一步詳述:
首先,請參閱圖2,為本發明一較佳實施例應用于播放機的系統結構圖。如圖所示,本發明主要設置有一CD讀取機構1與一射頻放大器2相連接,且該射頻放大器2與一CD-MP3單晶片集成電路3(又簡稱為CD-MP3SOC)相連接;該CD-MP3單晶片集成電路3與一電子防震緩沖儲存器4、一外部程序儲存器5、一VFD或LCD的驅動回路6及一促動器與傳動器的驅動回路7相連接;設有一VFD/LCD顯示器62與VFD/LCD的驅動回路6相連接,另設有一促動器與傳動器的驅動回路7與CD讀取機構1相連接。
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