[其他]先行控制的數據處理系統無效
| 申請號: | 85109251 | 申請日: | 1985-10-31 |
| 公開(公告)號: | CN85109251B | 公開(公告)日: | 1988-11-09 |
| 發明(設計)人: | 平島通;漆原哲夫 | 申請(專利權)人: | 富士通株式會社 |
| 主分類號: | G06F13/00 | 分類號: | G06F13/00 |
| 代理公司: | 中國國際貿易促進委員會專利代理部 | 代理人: | 李勇 |
| 地址: | 日本神奈*** | 國省代碼: | 暫無信息 |
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| 摘要: | 數據處理系統至少由一個主存貯器與中央控制器組成。主存貯器存放中央控制器要執行的指令。主存貯器內部包括一個偶數部分緩沖器與奇數部分緩沖器,分別用來臨時存放偶數地址與奇數地址的指令。這些經緩沖器的預取指令按序從這兩個緩沖器交替地送往中央處理器。 | ||
| 搜索關鍵詞: | 先行 控制 數據處理系統 | ||
【主權項】:
1.數據處理系統,至少包括一個主存貯器與一個中央控制器,中央控制器讀出存放在主存貯器內的指令,并執行這些讀出的指令;主存貯器包括一個偶數存貯器體與一個奇數存貯器體,分別由偶數地址與奇數地址確定,這兩個存貯器體彼此獨立工作;其特征在于:主存貯器還包括一個偶數預取指令緩沖器與奇數預取指令緩沖器,分別與偶數存貯體與奇數存貯器配合工作;在中央控制器發出取指請求(“IREQ”)之前主存貯器按序從偶數與奇數存貯器體讀出指令,并將這些讀出的指令存入相應的預取指令緩沖器;主存貯器在響應中央控制器發出的取指請求(“IREQ”)時對偶數與奇數預取指令緩沖器進行控制,使存放的預取指令交替地從偶數與奇數預取指令緩沖器產生,然后將它們送往中央控制器;主存貯器還包括一個偶數監測電路與一個奇數監測電路,它的產生結果監測信息,指示預取指令是否已經分別預先存入相應的預取指令緩沖器;中央控制器每次當指令序列發生中斷(例如地址跳步)時產生起動指令預取信號(“IPST”),用以啟動主存貯器中的預先讀數控制以及從存貯器體讀出的指令,起動指令預取信號是在發出取指信號(“IREQ”)之前發出的;和主存貯器由其中的存貯器控制邏輯電路控制,存貯器控制邏輯電路工作時根據監測電路的結果監測信息,完成從預取指令緩沖器預先讀取指令的操作,將這些讀出的指令存入預取指令寄存器,然后響應發出的取指請求(“IREQ”)將已存好的預取指令從相應的預取指令緩
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