[發(fā)明專利]一種輸出緩沖電路、驅(qū)動電路及顯示裝置在審
| 申請?zhí)枺?/td> | 202310584308.4 | 申請日: | 2023-05-23 |
| 公開(公告)號: | CN116597779A | 公開(公告)日: | 2023-08-15 |
| 發(fā)明(設(shè)計)人: | 王糖祥 | 申請(專利權(quán))人: | 北京京東方技術(shù)開發(fā)有限公司;京東方科技集團(tuán)股份有限公司 |
| 主分類號: | G09G3/3208 | 分類號: | G09G3/3208 |
| 代理公司: | 北京天昊聯(lián)合知識產(chǎn)權(quán)代理有限公司 11112 | 代理人: | 李迎亞;姜春咸 |
| 地址: | 100176 北京市大興區(qū)*** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 輸出 緩沖 電路 驅(qū)動 顯示裝置 | ||
本公開提供一種輸出緩沖電路、驅(qū)動電路及顯示裝置,屬于集成電路技術(shù)領(lǐng)域,其中,輸出緩沖電路包括N個輸入單元、求和單元、輸出單元、補償單元和補償控制單元;N≥1且N為整數(shù);第n個輸入單元被配置為在控制信號的控制下,將接收的第n個輸入信號轉(zhuǎn)換為電流信號,并輸出至求和單元;0<n≤N且n為整數(shù);求和單元被配置為對接收的電流信號進(jìn)行求和,并輸出至補償單元;補償單元被配置為對輸出緩沖電路進(jìn)行補償,并將接收的電流信號輸出至輸出單元;補償控制單元被配置為控制補償單元與求和單元和輸出單元之間的關(guān)斷和導(dǎo)通;輸出單元被配置為將接收的電流信號轉(zhuǎn)換為電壓信號后進(jìn)行輸出。
技術(shù)領(lǐng)域
本公開屬于集成電路技術(shù)領(lǐng)域,具體涉及一種輸出緩沖電路、驅(qū)動電路及顯示裝置。
背景技術(shù)
隨著消費者對顯示性能進(jìn)一步提升,硅基OLED顯示也面臨眾多挑戰(zhàn),這其中一個突出的挑戰(zhàn)就是,隨著顯示向高PPI,高刷新率發(fā)展,驅(qū)動電路的刷新也大大提高,對于每一行像素的充電時間變小,這要求源極驅(qū)動芯片(Source?driver,IC)的翻轉(zhuǎn)速度更快,即要求輸出緩沖器具有極高的擺率。
發(fā)明內(nèi)容
本公開旨在至少解決現(xiàn)有技術(shù)中存在的技術(shù)問題之一,提供一種輸出緩沖電路、驅(qū)動電路及顯示裝置。
第一方面,本公開實施例提供了一種輸出緩沖電路,包括N個輸入單元、求和單元、輸出單元、補償單元和補償控制單元;N≥1且N為整數(shù);
每一個所述輸入單元對應(yīng)一個輸入信號,第n個所述輸入單元對應(yīng)第n個輸入信號;0<n≤N且n為整數(shù);
第n個所述輸入單元的輸入端被配置為接收第n個輸入信號,輸出端與所述求和單元的輸入端連接,控制端被配置為接收控制信號;第n個所述輸入單元被配置為在控制信號的控制下,將接收的第n個輸入信號轉(zhuǎn)換為電流信號,并輸出至所述求和單元;
所述求和單元的輸出端與所述補償單元的輸入端連接,所述求和單元被配置為對接收的電流信號進(jìn)行求和,并輸出至所述補償單元;
所述補償單元的輸出端與所述輸出單元的輸入端連接,所述補償單元被配置為對所述輸出緩沖電路進(jìn)行補償,并將接收的電流信號輸出至所述輸出單元,所述補償控制單元被配置為控制所述補償單元與所述求和單元和所述輸出單元之間的關(guān)斷和導(dǎo)通;
所述輸出單元被配置為將接收的電流信號轉(zhuǎn)換為電壓信號后進(jìn)行輸出。
在一些實施例中,所述輸出緩沖電路還包括M個偏置單元,0<M≤N且M為整數(shù);
所述偏置單元被配置為向所述輸入單元提供控制信號,每一個所述偏置單元包括第一偏置子單元和第二偏置子單元,所述第一偏置子單元的輸入端連接第一電源電壓,所述第二偏置子單元的輸入端連接第二電源電壓。
在一些實施例中,所述輸出緩沖電路包括1個偏置單元,所述第一偏置子單元包括第一晶體管,所述第二偏置子單元包括第二晶體管,且所述第一晶體管為P型晶體管,所述第二晶體管為N型晶體管;
各所述輸入單元均包括四個晶體管;其中,第n個所述輸入單元包括一組P型差分對管和一組N型差分對管,所述P型差分對管包括第三晶體管和第四晶體管,所述N型差分對管包括第五晶體管和第六晶體管;
所述第一晶體管的第一極連接第一電源電壓端,所述第一晶體管的第二極連接所述第三晶體管的第一極和所述第四晶體管的第一極;
所述第三晶體管的控制極被配置為接收第n個輸入信號,所述第三晶體管的第二極連接所述求和單元;
所述第四晶體管的控制極連接所述輸出單元的第一輸出端,所述第四晶體管的第二極連接所述求和單元;
所述第二晶體管的第一極連接第二電源電壓端,所述第二晶體管的第二極連接所述第五晶體管的第一極和所述第六晶體管的第一極;
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