[發(fā)明專利]輔助可編程邏輯單元調(diào)試的方法、設(shè)備及系統(tǒng)在審
| 申請?zhí)枺?/td> | 202111324759.1 | 申請日： | 2021-11-10 |
| 公開（公告）號： | CN114116365A | 公開（公告）日： | 2022-03-01 |
| 發(fā)明（設(shè)計）人： | 袁坤;劉炳坤;劉海玲;高臣 | 申請（專利權(quán)）人： | 天津市英貝特航天科技有限公司 |
| 主分類號： | G06F11/273 | 分類號： | G06F11/273;G06F11/32 |
| 代理公司： | 天津市尚文知識產(chǎn)權(quán)代理有限公司 12222 | 代理人： | 徐楊陽 |
| 地址： | 300000 天津市濱海新區(qū)自*** | 國省代碼： | 天津;12 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 輔助 可編程 邏輯 單元 調(diào)試 方法 設(shè)備 系統(tǒng) | ||
本申請?zhí)峁┮环N輔助可編程邏輯單元調(diào)試的方法，包括：從可編程邏輯單元的一個管腳上接收調(diào)試信息；將所述調(diào)試信息進行解析獲得所述可編程器件的調(diào)試解析數(shù)據(jù)；將所述調(diào)試解析數(shù)據(jù)發(fā)送到顯示器件進行顯示，和發(fā)送到輸出單元以輸出所述調(diào)試解析數(shù)據(jù)。通過所述可編程邏輯單元的一個管腳獲取所述可編程邏輯單元的內(nèi)部調(diào)試數(shù)據(jù)進行直管的顯示，為開發(fā)人員準確及時的提供可編程單元的內(nèi)部運行情況，增加調(diào)試效率。本申請還提供一種輔助可編程邏輯單元調(diào)試的裝置、設(shè)備系統(tǒng)以及一種傳輸協(xié)議。
技術(shù)領(lǐng)域
本申請涉及到一種邏輯單元調(diào)試的技術(shù)，尤其涉及一種輔助可編程邏輯單元調(diào)試的方法。本申請還涉及一種輔助可編程邏輯單元調(diào)試的裝置、設(shè)備及系統(tǒng)。本申請還涉及一種通訊協(xié)議。
背景技術(shù)
可編程邏輯單元(CPLD，Complex Programming logic device)是一種邏輯功能可以按照用戶對器件的編程來確定的通用集成電路。CPLD內(nèi)部不含有RAM(隨機存取存儲器)，因此無法實現(xiàn)在線仿真的功能，對于一些比較大型的程序來說，目前對于接口的調(diào)試，只能使用外掛邏輯分析儀的方式對CPLD輸出接口進行調(diào)試，但是對于CPLD內(nèi)部的未輸出到接口上的邏輯狀態(tài)，外掛的邏輯分析儀是無法進行監(jiān)測的，也就沒辦法實現(xiàn)對CPLD的全功能邏輯的調(diào)試。
目前解決CPLD內(nèi)部邏輯的調(diào)試問題的方法多為外接指示燈，通過將CPLD內(nèi)部邏輯引出到指示燈上，觀察指示燈的狀態(tài)來調(diào)試CPLD內(nèi)部邏輯。但是這對開發(fā)設(shè)計要求很高，首先CPLD需要有足夠的管腳能夠連接足夠多的指示燈，其次CPLD內(nèi)部的邏輯顯示速率不能過高，因為過高的顯示速率會使指示燈一閃而過，調(diào)試人員來不及及時的通過指示燈判斷邏輯狀態(tài)。因此，通過這種調(diào)試方法對CPLD進行調(diào)試效率低下。
發(fā)明內(nèi)容
為了解決當前技術(shù)方案中調(diào)試CPLD效率低下的問題，本申請?zhí)岢鲆环N輔助可編程邏輯單元調(diào)試的方法以及一種輔助可編程邏輯單元調(diào)試的裝置。本申請還提出一種一種輔助可編程邏輯單元調(diào)試的設(shè)備、系統(tǒng)以及一種通訊協(xié)議。
本申請?zhí)峁┮环N輔助可編程邏輯單元調(diào)試的方法，包括：
從可編程邏輯單元的一個管腳上接收調(diào)試信息；
將所述調(diào)試信息進行解析獲得所述可編程器件的調(diào)試解析數(shù)據(jù)；
將所述調(diào)試解析數(shù)據(jù)發(fā)送到顯示器件進行顯示，和發(fā)送到輸出單元以輸出所述調(diào)試解析數(shù)據(jù)。
可選的，所述調(diào)試信息包括：第一調(diào)試信息；
所述第一調(diào)試信息是將所述輔助可編程邏輯單元的接口的邏輯電平值，按照時序先后填充到所述輔助可編程邏輯單元的通訊協(xié)議生成的。
可選的，所述調(diào)試信息包括：第二調(diào)試信息；
所述第二調(diào)試信息是將所述輔助可編程邏輯單元的寄存器值賦值到所述輔助可編程邏輯單元的通訊協(xié)議生成的。
本申請?zhí)峁┮环N通訊協(xié)議，用于所述可編程邏輯單元，包括：起始段、時鐘校準段、數(shù)據(jù)段和結(jié)尾段；
所述起始段包括：分別為30ns的高電平和低電平，所述高電平和低電平的時間誤差最大為5ns；
所述時鐘校準段包括：分別為20ns的高電平和低電平，所述高電平和低電平的時間誤差最大為15ns；
所述數(shù)據(jù)段包括8bit的傳輸信息，所述傳輸信息在所述時鐘校準段的時間內(nèi)，通過對所述輔助可編程邏輯單元進行信息采樣獲得；
所述結(jié)尾段沒有時間限制。
可選的，所述數(shù)據(jù)段的傳輸信息，高4位顯示到高位7段數(shù)碼管，低4位顯示到低位7段數(shù)碼管。
本申請還提供一種輔助可編程邏輯單元調(diào)試的裝置，包括：
單數(shù)據(jù)線單元，用于從可編程邏輯單元的一個管腳上接收調(diào)試信息；
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