[發明專利]像素處理電路、方法、裝置及電子設備有效
| 申請號: | 202110412034.1 | 申請日: | 2021-04-16 |
| 公開(公告)號: | CN113301262B | 公開(公告)日: | 2023-05-02 |
| 發明(設計)人: | 李沛德;楊淵明 | 申請(專利權)人: | 維沃移動通信(杭州)有限公司 |
| 主分類號: | H04N23/73 | 分類號: | H04N23/73;H04N25/53;H04N25/78;H04N25/77;H04N25/772;H04N25/70;H04N25/779;H04N25/60;H04N25/616;H04N25/65;H04N23/81;H04N23/54;H04N23/55;H04N2 |
| 代理公司: | 北京遠志博慧知識產權代理事務所(特殊普通合伙) 11680 | 代理人: | 李翠雅 |
| 地址: | 311100 浙江省杭州市*** | 國省代碼: | 浙江;33 |
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| 摘要: | |||
| 搜索關鍵詞: | 像素 處理 電路 方法 裝置 電子設備 | ||
本申請公開了一種像素處理電路、方法、裝置及電子設備,屬于通信技術領域,能夠解決電子設備拍攝的圖像的畫質較差的問題。該像素處理電路包括:控制邏輯模塊、第一RST重置門和第一電路模塊。其中,控制邏輯模塊的一端與第一RST重置門的一端連接,第一RST重置門的另一端與第一電路模塊連接;控制邏輯模塊用于在接收到第一控制信號的情況下,控制第一RST重置門處于第一工作狀態,第一RST重置門用于在第一工作狀態下,調整拍攝對象對應的像素矩陣中的至少一行像素和/或至少一列像素的曝光量,第一電路模塊用于對拍攝對象對應的光線進行處理。本申請實施例應用于對至少一行和/或至少一列的像素處理的過程中。
技術領域
本申請屬于通信技術領域,具體涉及一種像素處理電路、方法、裝置及電子設備。
背景技術
隨著終端技術的發展,用戶對電子設備的拍攝需求(例如圖像的畫質)越來越高,為了提升電子設備所拍攝的圖像的畫質,可以通過提升傳感器自身的信噪比,以提升圖像的信噪比,從而保證所拍攝的圖像的畫質。然而,由于在提升傳感器自身的信噪比的過程中,傳感器也會存在對應的噪聲(例如固定圖形噪聲(fixed?pattern?noise,FPN))以及圖像出現壞點壞線的問題,從而電子設備拍攝的圖像的畫質較差。
發明內容
本申請實施例的目的是提供一種像素處理電路、方法、裝置及電子設備,能夠解決電子設備拍攝的圖像的畫質較差的問題。
為了解決上述技術問題,本申請是這樣實現的:
第一方面,本申請實施例提供了一種像素處理電路,該像素處理電路包括:控制邏輯模塊、第一RST重置門和第一電路模塊。其中,控制邏輯模塊的一端與第一RST重置門的一端連接,第一RST重置門的另一端與第一電路模塊連接;控制邏輯模塊用于在接收到第一控制信號的情況下,控制第一RST重置門處于第一工作狀態,第一RST重置門用于在第一工作狀態下,調整拍攝對象對應的像素矩陣中的至少一行像素和/或至少一列像素的曝光量,第一電路模塊用于對拍攝對象對應的光線進行處理。
第二方面,本申請實施例提供了一種像素處理方法,該像素處理方法包括:獲取第一控制信號的至少一個觸發時間,該第一控制信號用于控制調整拍攝對象對應的像素矩陣中的至少一行像素和/或至少一列像素的曝光量,每個觸發時間對應像素矩陣中的一行像素或一列像素;在目標像素進行曝光的過程中,在目標時間觸發第一控制信號,以控制調整目標像素的曝光量,該目標像素為像素矩陣中與至少一個觸發時間對應的任意行像素或任意列像素,該目標時間為至少一個觸發時間中與目標像素對應的觸發時間。
第三方面,本申請實施例提供了一種像素處理裝置,該像素處理裝置包括:獲取模塊和觸發模塊。其中,獲取模塊,用于獲取第一控制信號的至少一個觸發時間,第一控制信號用于控制調整拍攝對象對應的像素矩陣中的至少一行像素和/或至少一列像素的曝光量,每個觸發時間對應像素矩陣中的一行像素或一列像素。觸發模塊,用于在目標像素進行曝光的過程中,在目標時間觸發第一控制信號,以控制調整目標像素的曝光量,該目標像素為像素矩陣中與至少一個觸發時間對應的任意行像素或任意列像素,該目標時間為至少一個觸發時間中與目標像素對應的觸發時間。
第四方面,本申請實施例提供了一種電子設備,該電子設備包括如第一方面所述的像素處理電路。
第五方面,本申請實施例提供了一種電子設備,該電子設備包括處理器、存儲器及存儲在所述存儲器上并可在所述處理器上運行的程序或指令,所述程序或指令被所述處理器執行時實現如第二方面所述的方法的步驟。
第六方面,本申請實施例提供了一種可讀存儲介質,所述可讀存儲介質上存儲程序或指令,所述程序或指令被處理器執行時實現如第二方面所述的方法的步驟。
第七方面,本申請實施例提供了一種芯片,所述芯片包括處理器和通信接口,所述通信接口和所述處理器耦合,所述處理器用于運行程序或指令,實現如第二方面所述的方法。
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