[發(fā)明專利]軟件硬件數(shù)據(jù)同步方法、裝置、電子設(shè)備和存儲介質(zhì)在審
| 申請?zhí)枺?/td> | 202110229144.4 | 申請日: | 2021-03-02 |
| 公開(公告)號: | CN113051082A | 公開(公告)日: | 2021-06-29 |
| 發(fā)明(設(shè)計)人: | 何妍 | 申請(專利權(quán))人: | 長沙景嘉微電子股份有限公司;長沙景美集成電路設(shè)計有限公司 |
| 主分類號: | G06F9/52 | 分類號: | G06F9/52;G06F9/54 |
| 代理公司: | 北京新知遠(yuǎn)方知識產(chǎn)權(quán)代理事務(wù)所(普通合伙) 11397 | 代理人: | 馬軍芳;張艷 |
| 地址: | 410221 湖南省長沙市岳*** | 國省代碼: | 湖南;43 |
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| 摘要: | |||
| 搜索關(guān)鍵詞: | 軟件 硬件 數(shù)據(jù) 同步 方法 裝置 電子設(shè)備 存儲 介質(zhì) | ||
1.一種軟件硬件數(shù)據(jù)同步方法,其特征在于,應(yīng)用于圖形處理器GPU的驅(qū)動程序,所述GPU還包括硬件模塊,所述方法包括:
獲取預(yù)設(shè)的事件隊列,其中,所述事件隊列包括多個事件;
根據(jù)所述事件隊列包括的各個事件對應(yīng)的事件類型在命令隊列中插入事件命令;
將所述GPU的硬件模塊執(zhí)行所述事件命令時觸發(fā)的中斷信號發(fā)送至CPU,以使所述CPU執(zhí)行所述事件隊列中的各個事件。
2.根據(jù)權(quán)利要求1所述的方法,其特征在于,所述獲取預(yù)設(shè)的事件隊列,包括:
獲取多個不同的事件類型,其中,所述事件類型包括等待、銷毀、加鎖及解鎖;
將多個不同的事件類型對應(yīng)的事件按照預(yù)設(shè)順序排列,獲得預(yù)設(shè)的事件隊列。
3.根據(jù)權(quán)利要求2所述的方法,所述獲取預(yù)設(shè)的事件隊列還包括:
獲取所述事件隊列的尾結(jié)點所在的位置;
將新增的事件隨機存儲至所述隊列的尾結(jié)點所在的位置;
更新所述隊列的尾結(jié)點的位置。
4.根據(jù)權(quán)利要求1所述的方法,其特征在于,所述根據(jù)所述事件隊列包括的多個事件的類型在命令隊列中插入事件命令,包括:
當(dāng)所述事件類型為銷毀時,在所述命令隊列的末尾插入銷毀類型對應(yīng)的事件命令,以使所述銷毀類型對應(yīng)的事件在所述命令隊列中最后被執(zhí)行。
5.根據(jù)權(quán)利要求1所述的方法,其特征在于,所述將所述GPU的硬件模塊執(zhí)行所述事件命令時觸發(fā)的中斷信號發(fā)送至CPU,以使所述CPU執(zhí)行所述事件隊列中的各個事件,包括:
當(dāng)所述CPU接收到所述中斷信號后,進入中斷服務(wù)程序,從所述事件隊列中獲取隊列的頭節(jié)點;
執(zhí)行所述隊列的頭節(jié)點中存儲的事件。
6.根據(jù)權(quán)利要求5所述的方法,其特征在于,在執(zhí)行所述隊列的頭節(jié)點中存儲的事件之后,所述方法還包括:
刪除所述被執(zhí)行的頭節(jié)點及所述頭節(jié)點中存儲的事件。
7.一種軟件硬件數(shù)據(jù)同步裝置,其特征在于,應(yīng)用于圖形處理器GPU的驅(qū)動程序,所述GPU還包括硬件模塊,所述裝置包括:
隊列獲取模塊,用于獲取預(yù)設(shè)的事件隊列,其中,所述事件隊列包括多個事件;
命令插入模塊,用于根據(jù)所述事件隊列包括的各個事件對應(yīng)的事件類型在命令隊列中插入事件命令;
執(zhí)行模塊,用于將所述GPU的硬件模塊執(zhí)行所述事件命令時觸發(fā)的中斷信號發(fā)送至CPU,以使所述CPU執(zhí)行所述事件隊列中的各個事件。
8.根據(jù)權(quán)利要求7所述的裝置,其特征在于,所述隊列獲取模塊具體用于:
獲取多個不同的事件類型,其中,所述事件類型包括等待、銷毀、加鎖及解鎖;
將多個不同的事件類型對應(yīng)的事件按照預(yù)設(shè)順序排列,獲得預(yù)設(shè)的事件隊列。
9.根據(jù)權(quán)利要求7所述的裝置,其特征在于,所述執(zhí)行模塊具體用于:
當(dāng)所述CPU接收到所述中斷信號后,進入中斷服務(wù)程序,從所述事件隊列中獲取隊列的頭節(jié)點;
執(zhí)行所述隊列的頭節(jié)點中存儲的事件。
10.一種電子設(shè)備,其特征在于,包括:處理器、存儲器和總線,所述處理器包括CPU和GPU,所述存儲器存儲有所述處理器可執(zhí)行的機器可讀指令,當(dāng)所述電子設(shè)備運行時,所述處理器與所述存儲器之間通過所述總線通信,所述機器可讀指令被所述處理器執(zhí)行時執(zhí)行如權(quán)利要求1-6任一項所述的軟件硬件數(shù)據(jù)同步方法。
11.一種存儲介質(zhì),其特征在于,所述存儲介質(zhì)上存儲有計算機程序,所述計算機程序被處理器運行時執(zhí)行如權(quán)利要求1-6任一項所述的軟件硬件數(shù)據(jù)同步方法。
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