[發(fā)明專利]處理器控制的可編程邏輯器件修改在審
| 申請(qǐng)?zhí)枺?/td> | 202010962859.6 | 申請(qǐng)日: | 2020-09-14 |
| 公開(公告)號(hào): | CN113094326A | 公開(公告)日: | 2021-07-09 |
| 發(fā)明(設(shè)計(jì))人: | N·多雷拉杰 | 申請(qǐng)(專利權(quán))人: | 英特爾公司 |
| 主分類號(hào): | G06F15/78 | 分類號(hào): | G06F15/78;G06F15/76;G06F30/34 |
| 代理公司: | 永新專利商標(biāo)代理有限公司 72002 | 代理人: | 劉文燦 |
| 地址: | 美國(guó)加*** | 國(guó)省代碼: | 暫無信息 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 處理器 控制 可編程 邏輯 器件 修改 | ||
本公開的系統(tǒng)或方法可以提供一種計(jì)算系統(tǒng),該計(jì)算系統(tǒng)包括處理器和可編程邏輯結(jié)構(gòu)的一個(gè)或多個(gè)可配置電路中的一個(gè)或多個(gè)所實(shí)現(xiàn)的設(shè)計(jì)。計(jì)算系統(tǒng)還包括耦合到可編程邏輯結(jié)構(gòu)的存儲(chǔ)器。計(jì)算系統(tǒng)進(jìn)一步包括內(nèi)聯(lián)地位于一個(gè)或多個(gè)可配置電路和存儲(chǔ)器之間的加速器。加速器是使用低級(jí)編程語言來定義的。處理器被耦合到加速器,并且被配置為通過將高級(jí)編程語言轉(zhuǎn)換為低級(jí)編程語言來實(shí)現(xiàn)對(duì)加速器的定義的修改,以改變加速器操作的方式。
背景技術(shù)
本公開總體上涉及集成電路,例如處理器和/或可編程邏輯器件(例如,現(xiàn)場(chǎng)可編程門陣列(FPGA))。更具體地,本公開涉及包含集成處理器和FPGA的電子設(shè)備。
本部分旨在向讀者介紹可以與本公開的各個(gè)方面相關(guān)的本領(lǐng)域的各個(gè)方面,下面將描述和/或要求保護(hù)這些內(nèi)容。該討論被認(rèn)為有助于向讀者提供背景信息,以促進(jìn)對(duì)本公開的各個(gè)方面的更好的理解。因此,可以理解的是,這些聲明應(yīng)從這種角度來解讀,而不是作為對(duì)現(xiàn)有技術(shù)的承認(rèn)。
現(xiàn)代電子產(chǎn)品(例如,計(jì)算機(jī)、便攜式設(shè)備、網(wǎng)絡(luò)路由器、數(shù)據(jù)中心、互聯(lián)網(wǎng)連接的裝置等)往往包括至少一個(gè)集成電路設(shè)備。集成電路設(shè)備可以呈現(xiàn)多種形式,包括處理器(例如,中央處理單元(CPU))、存儲(chǔ)器設(shè)備和可編程設(shè)備(例如,F(xiàn)PGA),僅舉幾個(gè)示例。特別地,可編程器件可以包括邏輯的可編程結(jié)構(gòu),其可以在制造之后被編程(例如,被配置)和被重新編程(例如,被重新配置),以基于電路設(shè)計(jì)提供各種各樣的功能。
可編程邏輯器件是可以被編程以執(zhí)行各種各樣的操作的一類集成電路。可編程邏輯器件可以包括被編程的可編程邏輯元件,這些可編程邏輯元件可以被編程以執(zhí)行自定義操作或?qū)崿F(xiàn)電路設(shè)計(jì)。為了將自定義操作和/或電路設(shè)計(jì)編程到可編程邏輯器件中,電路設(shè)計(jì)可以被編譯為位流并且被編程到可編程邏輯器件中的配置存儲(chǔ)器中。使用位流編程的值定義可編程邏輯器件的可編程邏輯元件的操作。在可編程邏輯器件中編程的特定功能可以是同步的。
在一些實(shí)施例中,可編程邏輯器件和處理器可以被集成在單個(gè)封裝或設(shè)備中,其中一些操作可以由可編程邏輯器件和處理器協(xié)同地執(zhí)行。例如,封裝可以包括片上系統(tǒng)(SoC),該片上系統(tǒng)包括處理器和可編程邏輯器件。然而,對(duì)可編程邏輯器件進(jìn)行編程利用了包括要在可編程邏輯器件上實(shí)現(xiàn)的指令的低級(jí)編程語言。
附圖說明
在閱讀了以下詳細(xì)的描述并參考了附圖時(shí),可以更好地理解本公開的各個(gè)方面,在附圖中:
圖1是根據(jù)本公開的實(shí)施例的計(jì)算系統(tǒng);
圖2是根據(jù)本公開的實(shí)施例的可編程邏輯器件;
圖3是根據(jù)本公開的實(shí)施例的數(shù)據(jù)處理系統(tǒng);
圖4是根據(jù)本公開的實(shí)施例的經(jīng)加速的數(shù)據(jù)處理系統(tǒng)的功能框圖;
圖5是根據(jù)本公開的實(shí)施例的處理器的處理流程圖;以及
圖6是根據(jù)本公開的相應(yīng)的實(shí)施例的數(shù)據(jù)處理系統(tǒng)。
具體實(shí)施方式
下面將描述一個(gè)或多個(gè)具體實(shí)施例。為了提供對(duì)這些實(shí)施例的簡(jiǎn)要描述,在說明書中并未描述實(shí)際的實(shí)施方式的所有特征。應(yīng)當(dāng)理解,在任何這種實(shí)際的實(shí)施方式的開發(fā)中,如在任何工程或設(shè)計(jì)項(xiàng)目中,都必須做出許多特定于實(shí)施方式的決策,以實(shí)現(xiàn)開發(fā)人員的具體目標(biāo),例如遵守系統(tǒng)相關(guān)的和業(yè)務(wù)相關(guān)的約束條件,這些約束條件可以因?qū)嵤┓绞蕉悺4送猓瑧?yīng)當(dāng)理解,這種開發(fā)工作可能是復(fù)雜且耗時(shí)的,但是對(duì)于受益于本公開的普通技術(shù)人員來說,將不過是設(shè)計(jì)、建造和制造的常規(guī)任務(wù)。
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