[發(fā)明專利]存儲器模塊在審
| 申請?zhí)枺?/td> | 202010499778.7 | 申請日： | 2020-06-04 |
| 公開（公告）號： | CN112052195A | 公開（公告）日： | 2020-12-08 |
| 發(fā)明（設(shè)計）人： | 林璇渶 | 申請（專利權(quán)）人： | 三星電子株式會社 |
| 主分類號： | G06F12/0804 | 分類號： | G06F12/0804 |
| 代理公司： | 北京市柳沈律師事務(wù)所 11105 | 代理人： | 邵亞麗 |
| 地址： | 韓國*** | 國省代碼： | 暫無信息 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 存儲器 模塊 | ||
1.一種存儲器模塊，包括：
第一內(nèi)部數(shù)據(jù)線；
第二內(nèi)部數(shù)據(jù)線；
易失性存儲器芯片，連接到所述第一內(nèi)部數(shù)據(jù)線；
非易失性存儲器芯片，連接到所述第二內(nèi)部數(shù)據(jù)線；
控制器，經(jīng)由所述第一內(nèi)部數(shù)據(jù)線和所述第二內(nèi)部數(shù)據(jù)線連接到所述易失性存儲器芯片和所述非易失性存儲器芯片，所述控制器被配置為：將與所述易失性存儲器芯片的第一數(shù)據(jù)相關(guān)的第一命令施加到所述易失性存儲器芯片，并將與所述非易失性存儲器芯片的第二數(shù)據(jù)相關(guān)的第二命令施加到所述非易失性存儲器芯片；和
數(shù)據(jù)緩沖器，經(jīng)由所述第一內(nèi)部數(shù)據(jù)線連接到所述易失性存儲器芯片和控制器，
其中，所述控制器還被配置為：在所述第一命令的第一等待時間和所述第二命令的第二等待時間彼此相一致的時間點(diǎn)，控制所述易失性存儲器芯片和所述非易失性存儲器芯片，以：
將所述第一數(shù)據(jù)從所述易失性存儲器芯片移動到所述非易失性存儲器芯片，或者
將所述第二數(shù)據(jù)從所述非易失性存儲器芯片移動到所述易失性存儲器芯片。
2.根據(jù)權(quán)利要求1所述的存儲器模塊，其中，所述控制器還被配置為：
在第一時間施加所述第一命令，
在所述第一時間之后的第二時間施加所述第二命令，
在第三時間，當(dāng)所述第一命令的所述第一等待時間和所述第二命令的所述第二等待時間彼此相一致時，將所述第一數(shù)據(jù)輸出到所述第一內(nèi)部數(shù)據(jù)線，以及
將所述第一數(shù)據(jù)作為所述第二數(shù)據(jù)從所述第一內(nèi)部數(shù)據(jù)線移動到所述非易失性存儲器芯片。
3.根據(jù)權(quán)利要求2所述的存儲器模塊，其中，所述控制器還被配置為：控制所述數(shù)據(jù)緩沖器，使得所述第一數(shù)據(jù)不被提供給所述存儲器模塊外部的數(shù)據(jù)總線。
4.根據(jù)權(quán)利要求2所述的存儲器模塊，其中，所述控制器還被配置為：在將所述第一數(shù)據(jù)輸出到所述第一內(nèi)部數(shù)據(jù)線之前，在所述第二時間施加所述第二命令。
5.根據(jù)權(quán)利要求1所述的存儲器模塊，其中，所述控制器還被配置為：
經(jīng)由所述存儲器模塊外部的命令地址總線接收與將所述第一數(shù)據(jù)從所述易失性存儲器芯片移動到所述非易失性存儲器芯片相關(guān)聯(lián)的數(shù)據(jù)移動請求，
經(jīng)由所述命令地址總線接收指向所述易失性存儲器芯片的讀取命令，所述讀取命令與被請求從所述易失性存儲器芯片讀取的所述第一數(shù)據(jù)的第一地址相關(guān)聯(lián)，
將所述讀取命令作為所述第一命令發(fā)送到所述易失性存儲器芯片，
接收指示所述第一數(shù)據(jù)要被寫入所述非易失性存儲器芯片中的位置的第二地址，
接收與所述非易失性存儲器芯片相關(guān)聯(lián)的寫入命令，
將所述寫入命令作為所述第二命令發(fā)送到所述非易失性存儲器芯片，
將在所述讀取命令的讀取等待時間之后從所述易失性存儲器芯片輸出到所述第一內(nèi)部數(shù)據(jù)線的所述第一數(shù)據(jù)在所述寫入命令的寫入等待時間之后配置作為所述第二數(shù)據(jù)，以及
控制將所述第二數(shù)據(jù)寫入所述非易失性存儲器芯片。
6.根據(jù)權(quán)利要求5所述的存儲器模塊，其中，所述控制器還被配置為：
在將所述讀取命令發(fā)送到所述易失性存儲器芯片之前，經(jīng)由所述命令地址總線、參考所述易失性存儲器芯片的所述第一地址接收指向所述易失性存儲器芯片的激活命令，以及
將所述激活命令發(fā)送到所述易失性存儲器芯片。
7.根據(jù)權(quán)利要求5所述的存儲器模塊，其中，所述控制器還被配置為：
在將所述寫入命令發(fā)送到所述非易失性存儲器芯片之前，經(jīng)由所述命令地址總線接收所述非易失性存儲器芯片的所述第二地址，以及
將所述第二地址發(fā)送到所述非易失性存儲器芯片。
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