[發(fā)明專利]一種自校準(zhǔn)分頻器在審
| 申請(qǐng)?zhí)枺?/td> | 202010144875.4 | 申請(qǐng)日： | 2020-03-04 |
| 公開（公告）號(hào)： | CN113364449A | 公開（公告）日： | 2021-09-07 |
| 發(fā)明（設(shè)計(jì)）人： | 楊峰;謝闊;陳東坡;丁萬(wàn)新;董佩偉;沈國(guó)平 | 申請(qǐng)（專利權(quán)）人： | 川土微電子（深圳）有限公司 |
| 主分類號(hào)： | H03K21/40 | 分類號(hào)： | H03K21/40;H03K21/10 |
| 代理公司： | 上海宏京知識(shí)產(chǎn)權(quán)代理事務(wù)所(普通合伙) 31297 | 代理人： | 鄧文武 |
| 地址： | 518054 廣東省深圳市南山區(qū)粵海街*** | 國(guó)省代碼： | 廣東;44 |
| 權(quán)利要求書： | 查看更多 | 說(shuō)明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 校準(zhǔn) 分頻器 | ||
1.一種自校準(zhǔn)分頻器，其特征在于，包括：分頻模塊、第一校準(zhǔn)模塊、第二校準(zhǔn)模塊及第三校準(zhǔn)模塊；
所述分頻模塊包括多個(gè)一一對(duì)應(yīng)的分頻單元及控制邏輯單元；
所述第一校準(zhǔn)模塊包括判斷單元、選擇輸出單元及信號(hào)輸出單元；
輸入信號(hào)接入所述分頻模塊，所述分頻模塊分別與所述第一校準(zhǔn)模塊及所述第二校準(zhǔn)模塊連接；
所述第一校準(zhǔn)模塊及所述第二校準(zhǔn)模塊的校準(zhǔn)信號(hào)輸出端均與所述第三校準(zhǔn)模塊連接，所述第三校準(zhǔn)模塊的輸出端作為所述分頻器的輸出端。
2.根據(jù)權(quán)利要求1所述的一種自校準(zhǔn)分頻器，其特征在于：所述分頻單元包括4個(gè)與門、兩個(gè)正相D觸發(fā)器、兩個(gè)反相D觸發(fā)器及一個(gè)或門；
正相D觸發(fā)器G5的時(shí)鐘信號(hào)端、正相D觸發(fā)器G6的時(shí)鐘信號(hào)端、反相D觸發(fā)器G7的時(shí)鐘信號(hào)端、反相D觸發(fā)器G8的時(shí)鐘信號(hào)端連接后作為所述分頻單元的第一引腳；
與門G1的一個(gè)輸入端與反相D觸發(fā)器G8的反相輸出端連接后，作為所述分頻單元的第七引腳，與門G1的另一個(gè)輸入端接反相D觸發(fā)器G7的反相輸出端，與門G1的輸出端接正相D觸發(fā)器G5的觸發(fā)信號(hào)端；
正相D觸發(fā)器G5的同相輸出端接反相D觸發(fā)器G8的觸發(fā)信號(hào)端及或門G9的一個(gè)輸入端；
反相D觸發(fā)器G8的同相輸出端接與門G3的一個(gè)輸入端；
與門G3的另一個(gè)輸入端作為所述分頻單元的第五引腳，與門G3的輸出端接正相D觸發(fā)器G6的觸發(fā)信號(hào)端；
正相D觸發(fā)器G6的同相輸出端、與門G2的一個(gè)輸入端、或門G9的另一端輸入端連接后，作為所述分頻單元的第三引腳；
與門G2的另一個(gè)輸入端作為所述分頻單元的第四引腳；與門G2的輸出端接反相D觸發(fā)器G7的觸發(fā)信號(hào)端；
或門G9的輸出端接與門G4的一個(gè)輸入端；
與門G4的另一個(gè)輸入端作為所述分頻單元的第二引腳，與門G4的輸出端作為所述分頻單元的第六引腳。
3.根據(jù)權(quán)利要求2所述的一種自校準(zhǔn)分頻器，其特征在于：所述控制邏輯單元包括非門G10、或門G11及或門G12；
或門G11的一個(gè)輸入端作為所述控制邏輯單元的第一引腳，非門G10的輸入端作為所述控制邏輯單元的第三引腳，或門G12的一個(gè)輸入端作為所述控制邏輯單元的第二引腳，非門G10的輸出端同時(shí)接或門G11、或門G12的另一輸入端，或門G11的輸出端作為所述控制邏輯單元的第五引腳，或門G12的輸出端作為所述控制邏輯單元的第四引腳。
4.根據(jù)權(quán)利要求3所述的一種自校準(zhǔn)分頻器，其特征在于：所述分頻模塊包括九個(gè)分頻單元及與之相對(duì)應(yīng)的九個(gè)控制邏輯單元；
第一分頻單元的第一引腳與輸入信號(hào)連接；其余分頻單元的第一引腳均與前一分頻單元的第七引腳連接；
每一個(gè)分頻單元的第二引腳均與所述選擇輸出單元的輸出端連接；
每一個(gè)分頻單元的第三引腳均與相應(yīng)的控制邏輯單元的第一引腳連接；
每一個(gè)分頻單元的第四引腳均與相應(yīng)的控制邏輯單元的第二引腳及所述第二校準(zhǔn)模塊的輸出端連接；
每一個(gè)分頻單元的第五引腳均與后一控制邏輯單元的第五引腳連接；
每一個(gè)分頻單元的第六引腳均與所述信號(hào)輸出單元的輸入端連接；
第九控制邏輯單元的第三引腳與所述第二校準(zhǔn)模塊的輸出端連接，其余控制邏輯單元的第三引腳均與相鄰的控制邏輯單元的第四引腳連接；
第一控制邏輯單元的第五引腳輸出信號(hào)到所述第二校準(zhǔn)模塊的輸入端。
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