[發(fā)明專利]一種等效采樣的測量分辨率提高裝置有效
| 申請?zhí)枺?/td> | 202010058925.7 | 申請日： | 2020-01-19 |
| 公開（公告）號： | CN111245436B | 公開（公告）日： | 2021-10-22 |
| 發(fā)明（設(shè)計）人： | 王鋰;黃習(xí)斌;戴志堅 | 申請（專利權(quán)）人： | 電子科技大學(xué) |
| 主分類號： | H03M1/12 | 分類號： | H03M1/12;G01R19/25;G01R1/30 |
| 代理公司： | 成都行之專利代理事務(wù)所(普通合伙) 51220 | 代理人： | 溫利平 |
| 地址： | 611731 四川省成*** | 國省代碼： | 四川;51 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 等效 采樣 測量 分辨率 提高 裝置 | ||
1.一種等效采樣的測量分辨率提高裝置，其特征在于，包括：
參考時鐘源，為FPGA提供準確參考時鐘；
幅度放大電路，在FPGA的控制下，用于放大被測信號的電壓以滿足一定幅度倍數(shù)關(guān)系；
幅度偏置電路，在FPGA的控制下，對被放大后的被測信號施加偏置，以保證k個不同幅度片段的波形滿足ADC的量程范圍；
ADC采樣電路，利用ADC依次對k個不同幅度片段的波形進行依次采集，實現(xiàn)了ADC測量分辨率k倍的提高，最后將采集的波形發(fā)送給FPGA；
FPGA，利用自帶的IO端口控制幅度放大電路的放大倍率與幅度偏置電路的偏置電壓，從而使被測信號滿足裝置需要；利用內(nèi)嵌的高速串行收發(fā)器IP核實現(xiàn)對多路ADC輸出的數(shù)字信號的接收，然后根據(jù)放大倍率拼接、還原出被測信號；
其中，ADC測量分辨率為：
其中，X為整個裝置的測量分辨率，n為ADC的分辨率位數(shù)，2n為ADC的測量分辨率，B為幅度放大電路放大后的波形幅度，A為ADC的量程值。
2.根據(jù)權(quán)利要求1所述的一種等效采樣的測量分辨率提高裝置，其特征在于，所述幅度偏置電路對被放大后的被測信號施加偏置的具體過程為：
設(shè)幅度放大電路輸出波形的幅度滿足0V到k倍ADC量程范圍，依次施加0V偏置、負一倍ADC量程范圍偏置至負k-2倍ADC量程范圍偏置以及負k-1倍ADC量程范圍偏置，從而將幅度放大電路輸出波形剪切形成為0V到一倍ADC量程范圍、一倍到二倍ADC量程范圍、二倍到三倍ADC量程范圍、直到k-1倍到k倍ADC量程范圍的k個幅度片段。
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