[發(fā)明專利]一種電壓補(bǔ)償電路及顯示器在審
| 申請?zhí)枺?/td> | 202010046618.7 | 申請日： | 2020-01-16 |
| 公開（公告）號： | CN111540302A | 公開（公告）日： | 2020-08-14 |
| 發(fā)明（設(shè)計）人： | 鄭士嵩 | 申請（專利權(quán)）人： | 重慶康佳光電技術(shù)研究院有限公司 |
| 主分類號： | G09G3/32 | 分類號： | G09G3/32;G09G3/3208 |
| 代理公司： | 深圳市君勝知識產(chǎn)權(quán)代理事務(wù)所(普通合伙) 44268 | 代理人： | 吳志益;王永文 |
| 地址： | 402760 重慶市璧*** | 國省代碼： | 重慶;50 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 電壓 補(bǔ)償 電路 顯示器 | ||
1.一種電壓補(bǔ)償電路，其特征在于，所述電路包括：
電激發(fā)光器件；
驅(qū)動單元，用于驅(qū)動電激發(fā)光器件；
發(fā)光時長控制單元，與所述驅(qū)動單元和所述電激發(fā)光器件分別連接，用于控制電激發(fā)光器件的發(fā)光時間；
補(bǔ)償單元，與所述驅(qū)動單元和所述發(fā)光時長控制單元分別連接，用于為所述電壓補(bǔ)償電路提供補(bǔ)償電壓。
2.根據(jù)權(quán)利要求1所述的電壓補(bǔ)償電路，其特征在于，通過一外部電路輸入一固定電流至所述補(bǔ)償單元，所述補(bǔ)償單元接收所述固定電流并輸出一補(bǔ)償電壓經(jīng)至所述驅(qū)動單元，所述驅(qū)動單元接收所述補(bǔ)償電壓并輸出一穩(wěn)定電流經(jīng)所述發(fā)光時長控制單元后至所述電激發(fā)光器件以驅(qū)動所述電激發(fā)光器件。
3.根據(jù)權(quán)利要求1所述的電壓補(bǔ)償電路，其特征在于，輸入一第一參考電壓至所述補(bǔ)償單元，所述補(bǔ)償單元根據(jù)所述第一參考電壓調(diào)節(jié)所述補(bǔ)償電壓的大小。
4.根據(jù)權(quán)利要求2所述的電壓補(bǔ)償電路，其特征在于，輸入一第二參考電壓至所述補(bǔ)償單元，以使所述驅(qū)動單元獲得一可調(diào)節(jié)跨壓，并輸出一穩(wěn)定電流經(jīng)所述發(fā)光時長控制單元后至所述電激發(fā)光器件以驅(qū)動所述電激發(fā)光器件。
5.根據(jù)權(quán)利要求4所述的電壓補(bǔ)償電路，其特征在于，所述補(bǔ)償單元，包括：
第二晶體管、第三晶體管、第四晶體管、第五晶體管和電容；
所述第四晶體管的柵極與第一信號控制端連接，所述第四晶體管的源極與第一參考電壓連接，所述第四晶體管的漏極與所述電容的第一端連接；所述電容的第二端與所述第三晶體管的源極連接，所述第三晶體管的漏極與所述第二晶體管的源極連接，所述第二晶體管的漏極與固定電流輸入端連接；所述第一信號控制端還分別與所述第二晶體管的柵極和所述第三晶體管的柵極連接；
所述第五晶體管的源極與第二參考電壓連接，所述第五晶體管的漏極與所述電容的第一端連接，所述第五晶體管的柵極與第二信號控制端連接。
6.根據(jù)權(quán)利要求5所述的電壓補(bǔ)償電路，其特征在于，所述驅(qū)動單元，包括：
第一晶體管；
所述第一晶體管的柵極與所述電容的第二端連接，所述第一晶體管的源極與電源端連接，所述第一晶體管的漏極與第一開關(guān)晶體管的源極連接。
7.根據(jù)權(quán)利要求6所述的電壓補(bǔ)償電路，其特征在于，所述發(fā)光時長控制單元，包括：
第一開關(guān)晶體管和第二開關(guān)晶體管；
所述第一開關(guān)晶體管的源極與所述第一晶體管的漏極連接，所述第一開關(guān)晶體管的漏極與所述第二開關(guān)晶體管的源極連接，所述第一開關(guān)晶體管的柵極與所述第二信號控制端連接；所述第二開關(guān)晶體管的源極與所述第一開關(guān)晶體管的漏極連接，所述第二開關(guān)晶體管的漏極與所述電激發(fā)光器件的陽極連接，所述第二開關(guān)晶體管的柵極與第三信號控制端連接；所述電激發(fā)光器件的陰極接地。
8.根據(jù)權(quán)利要求4所述的電壓補(bǔ)償電路，其特征在于，所述補(bǔ)償單元，包括：
第二晶體管、第三晶體管、第四晶體管、第五晶體管和電容；
所述第四晶體管的柵極與第一信號控制端連接，所述第四晶體管的源極與第一參考電壓連接，第四晶體管的漏極與所述電容的第一端連接；所述電容的第二端與所述第三晶體管的源極連接，所述第三晶體管的漏極與所述第二晶體管的源極連接，所述第二晶體管的漏極與固定電流輸入端連接；第一信號控制端還分別與所述第二晶體管的柵極和所述第三晶體管的柵極連接；
所述第五晶體管的源極與第二參考電壓連接，所述第五晶體管的漏極與所述電容的第一端連接。
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