[發(fā)明專利]涉及在低速操作環(huán)境中執(zhí)行高速測試的半導(dǎo)體設(shè)備和系統(tǒng)有效
| 申請?zhí)枺?/td> | 201811020943.5 | 申請日: | 2018-09-03 |
| 公開(公告)號: | CN109949853B | 公開(公告)日: | 2023-06-02 |
| 發(fā)明(設(shè)計)人: | 張修寧;車鎮(zhèn)燁 | 申請(專利權(quán))人: | 愛思開海力士有限公司 |
| 主分類號: | G11C29/12 | 分類號: | G11C29/12;G11C29/50;G01R31/26 |
| 代理公司: | 北京弘權(quán)知識產(chǎn)權(quán)代理有限公司 11363 | 代理人: | 許偉群;郭放 |
| 地址: | 韓國*** | 國省代碼: | 暫無信息 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 涉及 低速 操作 環(huán)境 執(zhí)行 高速 測試 半導(dǎo)體設(shè)備 系統(tǒng) | ||
1.一種半導(dǎo)體系統(tǒng),包括:
第一半導(dǎo)體設(shè)備和第二半導(dǎo)體設(shè)備,
其中,所述第一半導(dǎo)體設(shè)備基于通過將第一時鐘信號分頻而產(chǎn)生的第一內(nèi)部時鐘信號將參考數(shù)據(jù)輸出為傳輸數(shù)據(jù),以及
其中,所述第二半導(dǎo)體設(shè)備通過基于通過將所述第一時鐘信號分頻而產(chǎn)生的第二內(nèi)部時鐘信號接收所述傳輸數(shù)據(jù)來產(chǎn)生接收數(shù)據(jù),以及基于所述接收數(shù)據(jù)和所述參考數(shù)據(jù)來產(chǎn)生錯誤檢測信號。
2.根據(jù)權(quán)利要求1所述的半導(dǎo)體系統(tǒng),
其中,所述第一內(nèi)部時鐘信號是通過將所述第一時鐘信號分頻而產(chǎn)生以允許利用與大于所述第一時鐘信號的頻率相對應(yīng)的目標(biāo)頻率將所述參考數(shù)據(jù)輸出為所述傳輸數(shù)據(jù),以及
其中,所述第二內(nèi)部時鐘信號是通過將所述第一時鐘信號分頻而產(chǎn)生以允許利用與大于所述第一時鐘信號的頻率相對應(yīng)的所述目標(biāo)頻率來接收所述傳輸數(shù)據(jù)并且產(chǎn)生所述接收數(shù)據(jù)。
3.根據(jù)權(quán)利要求1所述的半導(dǎo)體系統(tǒng),其中,所述第二半導(dǎo)體設(shè)備通過將所述接收數(shù)據(jù)與所述參考數(shù)據(jù)進行比較來產(chǎn)生所述錯誤檢測信號。
4.根據(jù)權(quán)利要求1所述的半導(dǎo)體系統(tǒng),其中,所述第一半導(dǎo)體設(shè)備包括:
第一時鐘發(fā)生電路,其被配置為將所述第一時鐘信號分頻并且產(chǎn)生所述第一內(nèi)部時鐘信號;以及
數(shù)據(jù)輸出電路,其被配置為同步于所述第一內(nèi)部時鐘信號將所述參考數(shù)據(jù)輸出為所述傳輸數(shù)據(jù)。
5.根據(jù)權(quán)利要求1所述的半導(dǎo)體系統(tǒng),其中,所述第二半導(dǎo)體設(shè)備包括:
第二時鐘發(fā)生電路,其被配置為將所述第一時鐘信號分頻并且產(chǎn)生所述第二內(nèi)部時鐘信號;
數(shù)據(jù)接收電路,其被配置為基于所述第二內(nèi)部時鐘信號從所述傳輸數(shù)據(jù)產(chǎn)生所述接收數(shù)據(jù);以及
錯誤檢測電路,其被配置為通過將所述參考數(shù)據(jù)與所述接收數(shù)據(jù)進行比較來產(chǎn)生所述錯誤檢測信號。
6.根據(jù)權(quán)利要求1所述的半導(dǎo)體系統(tǒng),
其中,所述第一半導(dǎo)體設(shè)備的數(shù)據(jù)總線和所述第二半導(dǎo)體設(shè)備的數(shù)據(jù)總線耦接,以及
其中,所述第二半導(dǎo)體設(shè)備經(jīng)由所述第一半導(dǎo)體設(shè)備的數(shù)據(jù)總線和所述第二半導(dǎo)體設(shè)備的數(shù)據(jù)總線來接收所述傳輸數(shù)據(jù)。
7.根據(jù)權(quán)利要求1所述的半導(dǎo)體系統(tǒng),
其中,所述第二半導(dǎo)體設(shè)備還包括:
時鐘門控電路,其被配置為延遲所述第二內(nèi)部時鐘信號,并向數(shù)據(jù)接收電路提供延遲的所述第二內(nèi)部時鐘信號,以及
其中,所述時鐘門控電路的延遲量對應(yīng)于如下時間,所述時間是通過將所述第一時鐘信號輸入所述第一半導(dǎo)體設(shè)備的時刻至所述傳輸數(shù)據(jù)從所述第一半導(dǎo)體設(shè)備輸出的時刻的時間減去所述第一時鐘信號輸入所述第二半導(dǎo)體設(shè)備的時刻至所述第二半導(dǎo)體設(shè)備產(chǎn)生所述第二內(nèi)部時鐘信號的時刻的時間而獲得。
8.根據(jù)權(quán)利要求1所述的半導(dǎo)體系統(tǒng),
其中,所述第一半導(dǎo)體設(shè)備和所述第二半導(dǎo)體設(shè)備分別包括命令地址總線,以及
其中,所述第一半導(dǎo)體設(shè)備和所述第二半導(dǎo)體設(shè)備還分別包括寄存器,所述寄存器基于經(jīng)由所述命令地址總線傳輸?shù)拿畹刂沸盘杹韮Υ嫠鰠⒖紨?shù)據(jù)。
9.一種半導(dǎo)體系統(tǒng),包括:
外部設(shè)備,其被配置為提供第一時鐘信號和參考數(shù)據(jù);
第一半導(dǎo)體設(shè)備,其被配置為:通過將所述第一時鐘信號分頻而產(chǎn)生第一內(nèi)部時鐘信號,以及基于所述第一內(nèi)部時鐘信號將所述參考數(shù)據(jù)輸出為傳輸數(shù)據(jù);以及
第二半導(dǎo)體設(shè)備,其被配置為:通過將所述第一時鐘信號分頻而產(chǎn)生第二內(nèi)部時鐘信號,通過基于所述第二內(nèi)部時鐘信號接收所述傳輸數(shù)據(jù)來產(chǎn)生接收數(shù)據(jù),以及被配置為:基于所述參考數(shù)據(jù)和所述接收數(shù)據(jù)來產(chǎn)生錯誤檢測信號。
10.根據(jù)權(quán)利要求9所述的半導(dǎo)體系統(tǒng),其中,所述第二半導(dǎo)體設(shè)備通過將所述接收數(shù)據(jù)與所述參考數(shù)據(jù)進行比較來產(chǎn)生錯誤檢測信號。
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