[實(shí)用新型]一種時(shí)間放大器和半導(dǎo)體存儲(chǔ)器有效
| 申請(qǐng)?zhí)枺?/td> | 201721519124.6 | 申請(qǐng)日: | 2017-11-14 |
| 公開(公告)號(hào): | CN207475497U | 公開(公告)日: | 2018-06-08 |
| 發(fā)明(設(shè)計(jì))人: | 賴榮欽 | 申請(qǐng)(專利權(quán))人: | 睿力集成電路有限公司 |
| 主分類號(hào): | H03G3/30 | 分類號(hào): | H03G3/30 |
| 代理公司: | 北京市鑄成律師事務(wù)所 11313 | 代理人: | 張臻賢;武晨燕 |
| 地址: | 230000 安徽省合肥市*** | 國(guó)省代碼: | 安徽;34 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 電容 時(shí)間放大器 半導(dǎo)體存儲(chǔ)器 邏輯信號(hào)控制 本實(shí)用新型 放大增益 時(shí)間點(diǎn) 預(yù)定時(shí)間間隔 技術(shù)效果 時(shí)間脈沖 增益可調(diào) 輸出 脈沖 減小 嵌入 延遲 | ||
1.一種時(shí)間放大器,其特征在于,包括:
第一閂鎖器和第一緩存器,所述第一緩存器用于接受第一時(shí)間脈沖的輸入,所述第一閂鎖器的第一閂鎖輸入端與所述第一緩存器的輸出端連接,所述第一閂鎖器的第二閂鎖輸入端接收第二時(shí)間脈沖,所述第一閂鎖器的Q輸出端藕接有第一電容,所述第一閂鎖器的Q1輸出端耦接有第二電容;及
第一D觸發(fā)器,所述第一D觸發(fā)器的第一觸發(fā)輸入端從所述第一緩存器接收經(jīng)延遲預(yù)定時(shí)間間隔的所述第一時(shí)間脈沖,所述第一D觸發(fā)器的第二觸發(fā)輸入端接收所述第二時(shí)間脈沖,所述第一D觸發(fā)器的第一觸發(fā)輸出端與所述第一電容和所述第二電容中的至少一個(gè)連接,用于控制調(diào)節(jié)所述第一電容和所述第二電容的電容值。
2.如權(quán)利要求1所述的時(shí)間放大器,其特征在于,所述第一緩存器包括相互串聯(lián)的多個(gè)第一緩存單元,各所述第一緩存單元用于延遲輸入所述第一緩存器的信號(hào),多個(gè)所述第一緩存單元共同將所述第一時(shí)間脈沖延遲所述預(yù)定時(shí)間間隔。
3.如權(quán)利要求2所述的時(shí)間放大器,其特征在于,還包括:
第二閂鎖器和第二緩存器,所述第二緩存器用于接受第二時(shí)間脈沖的輸入,所述第二閂鎖器的第三閂鎖輸入端與所述第二緩存器的輸出端連接,所述第二閂鎖器的第四閂鎖輸入端接收第一時(shí)間脈沖,所述第二閂鎖器的Q輸出端藕接有第三電容,所述第二閂鎖器的Q1輸出端耦接有第四電容;
第二D觸發(fā)器,所述第二D觸發(fā)器的第三觸發(fā)輸入端從所述第二緩存器接收經(jīng)延遲所述預(yù)定時(shí)間間隔的所述第二時(shí)間脈沖,所述第二D觸發(fā)器的第四觸發(fā)輸入端接收所述第一時(shí)間脈沖,所述第二D觸發(fā)器的第二觸發(fā)輸出端與所述第三電容和所述第四電容中的至少一個(gè)連接,用于控制調(diào)節(jié)所述第三電容和所述第四電容的電容值。
4.如權(quán)利要求3所述的時(shí)間放大器,其特征在于,所述第二緩存器包括相互串聯(lián)的多個(gè)第二緩存單元,各所述第二緩存單元用于延遲輸入所述第二緩存器的信號(hào),多個(gè)所述第二緩存單元共同將所述第二時(shí)間脈沖延遲所述預(yù)定時(shí)間間隔。
5.如權(quán)利要求4所述的時(shí)間放大器,其特征在于,還包括:
或門,所述或門的第一輸入端與所述第一D觸發(fā)器的所述第一觸發(fā)輸出端連接,所述或門的第二輸入端與所述第二D觸發(fā)器的所述第二觸發(fā)輸出端連接,所述或門的輸出端與所述第一電容、所述第二電容、所述第三電容或所述第四電容連接。
6.如權(quán)利要求5所述的時(shí)間放大器,其特征在于,還包括與所述第一閂鎖器的Q輸出端和Q1輸出端連接的第一或非門,以及與所述第二閂鎖器的Q輸出端和Q1輸出端連接的第二或非門。
7.如權(quán)利要求6所述的時(shí)間放大器,其特征在于,所述第一電容、所述第二電容、所述第三電容和所述第四電容的其中一個(gè)電容至少包括:
至少兩條支路,所述支路之間并聯(lián),所述支路的輸入端與對(duì)應(yīng)的所述第一閂鎖器或所述第二閂鎖器的輸出端連接,所述支路的輸出端接地;
其中,所述支路由支路電容以及與所述支路電容串聯(lián)的開關(guān)組成,所述開關(guān)受到對(duì)應(yīng)連接的所述第一D觸發(fā)器或所述第二D觸發(fā)器的或邏輯控制。
8.如權(quán)利要求7所述的時(shí)間放大器,其特征在于,所述開關(guān)包括:
與非門,由對(duì)應(yīng)連接的所述第一D觸發(fā)器或所述第二D觸發(fā)器的或邏輯控制所述與非門的接觸引腳是否接入所述支路。
9.如權(quán)利要求8所述的時(shí)間放大器,其特征在于,當(dāng)所述接觸引腳接入所述支路時(shí),對(duì)應(yīng)連接的所述第一D觸發(fā)器或所述第二D觸發(fā)器發(fā)送控制信號(hào)至所述與非門的控制引腳。
10.一種半導(dǎo)體存儲(chǔ)器,其特征在于,包括權(quán)利要求1至9任一項(xiàng)所述的時(shí)間放大器。
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