[發明專利]一種基于FPGA的Sigma-Delta調制器在審
| 申請號： | 201711210994.X | 申請日： | 2017-11-23 |
| 公開（公告）號： | CN108123719A | 公開（公告）日： | 2018-06-05 |
| 發明（設計）人： | 戈立軍;趙瑞君;李曉穎;趙瀾 | 申請（專利權）人： | 天津工業大學 |
| 主分類號： | H03M3/00 | 分類號： | H03M3/00 |
| 代理公司： | 暫無信息 | 代理人： | 暫無信息 |
| 地址： | 300387 *** | 國省代碼： | 天津;12 |
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| 摘要： | |||
| 搜索關鍵詞： | 量化噪聲 調制器 數字濾波器結構 結構復雜度 改進結構 減小延時 擴頻通信 一級結構 噪聲整形 第一級 高延時 引入 前饋 時延 跳頻 電路 分析 反饋 改進 | ||
1.一種基于FPGA的Sigma-Delta調制器，其特征在于：在第二級結構中引入兩個前饋結構，進而使得2-2MASH結構的第一級結構中數字濾波器簡化。
2.根據權利1所述的在第二級結構中引入兩個前饋結構，其特征在于：從第一級和第二級間g3耦合器輸出端引出，分別送入第二級的第二個和第三個加法器中。
3.根據權利1所述的將第一級結構中數字濾波器結構進行簡化，其特征在于：在一級調制器輸出的Y1之后濾波器的z域表達為：
H(z)＝z-1
4.根據權利1所述的在第二級結構中引入兩個前饋結構，進而使得MASH結構第一級結構中數字濾波器簡化，其特征在于：得到最終輸入輸出關系的z域表達式：
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