[發(fā)明專利]移位寄存器單元及其驅動方法、柵極驅動電路及顯示裝置有效
| 申請?zhí)枺?/td> | 201711022194.5 | 申請日： | 2017-10-26 |
| 公開（公告）號： | CN107610737B | 公開（公告）日： | 2023-07-21 |
| 發(fā)明（設計）人： | 黃飛 | 申請（專利權）人： | 京東方科技集團股份有限公司;鄂爾多斯市源盛光電有限責任公司 |
| 主分類號： | G11C19/28 | 分類號： | G11C19/28;G09G3/3266;G09G3/36 |
| 代理公司： | 北京三高永信知識產權代理有限責任公司 11138 | 代理人： | 滕一斌 |
| 地址： | 100015 *** | 國省代碼： | 北京;11 |
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| 摘要： | |||
| 搜索關鍵詞： | 移位寄存器 單元 及其 驅動 方法 柵極 電路 顯示裝置 | ||
1.一種移位寄存器單元，其特征在于，所述移位寄存器單元包括：輸入模塊、復位模塊、傳輸模塊和輸出控制模塊；
所述輸入模塊分別與輸入信號端、第一控制信號端、第二控制信號端、第一節(jié)點和第二節(jié)點連接，用于在所述輸入信號端、所述第一控制信號端、所述第二控制信號端和所述第二節(jié)點的控制下，控制所述第一節(jié)點的電位；
所述復位模塊分別與復位信號端、第一電源端和所述第一節(jié)點連接，用于在所述復位信號端和所述第一電源端的控制下，控制所述第一節(jié)點的電位；
所述傳輸模塊分別與所述第一節(jié)點、所述第二節(jié)點、時鐘信號端和第二電源端連接，用于在所述第一節(jié)點、所述第二節(jié)點、所述時鐘信號端和所述第二電源端的控制下，控制所述第二節(jié)點的電位；
所述輸出控制模塊分別與所述第二節(jié)點和輸出信號端連接，用于在所述第二節(jié)點的控制下，控制所述輸出信號端的電位；
其中，所述輸出控制模塊用于在所述第二節(jié)點的電位為第一電位時，控制所述輸出信號端的電位為第二電位，以及在所述第二節(jié)點的電位為第二電位時，控制所述輸出信號端的電位為第一電位；所述輸出控制模塊包括：控制子模塊和輸出子模塊；
所述控制子模塊分別與所述第二節(jié)點和第三節(jié)點連接，用于在所述第二節(jié)點的電位為第一電位時，控制所述第三節(jié)點的電位為第一電位，以及在所述第二節(jié)點的電位為第二電位時，控制所述第三節(jié)點的電位為第二電位；
所述輸出子模塊分別與所述第三節(jié)點和所述輸出信號端連接，用于在所述第三節(jié)點的電位為第一電位時，控制所述輸出信號端的電位為第二電位，以及在所述第三節(jié)點的電位為第二電位時，控制所述輸出信號端的電位為第一電位。
2.根據(jù)權利要求1所述的移位寄存器單元，其特征在于，所述輸入模塊包括：第一傳輸門以及或非門；
所述第一傳輸門的第一控制端與所述第一控制信號端連接，所述第一傳輸門的第二控制端與所述第二控制信號端連接，所述第一傳輸門的輸入端與所述輸入信號端連接，所述第一傳輸門的輸出端與所述或非門的第一輸入端連接；
所述或非門的第二輸入端與所述第二節(jié)點連接，所述或非門的輸出端與所述第一節(jié)點連接。
3.根據(jù)權利要求1所述的移位寄存器單元，其特征在于，所述復位模塊包括：第一晶體管；
所述第一晶體管的柵極與所述復位信號端連接，所述第一晶體管的第一極與所述第一電源端連接，所述第一晶體管的第二極與所述第一節(jié)點連接。
4.根據(jù)權利要求1所述的移位寄存器單元，其特征在于，所述傳輸模塊包括：第一反相器、第二傳輸門、第二晶體管以及第二反相器；
所述第一反相器的輸入端與所述第一節(jié)點連接，所述第一反相器的輸出端與所述第二傳輸門的第一控制端連接；
所述第二傳輸門的第二控制端與所述第一節(jié)點連接，所述第二傳輸門的輸入端與所述時鐘信號端連接，所述第二傳輸門的輸出端與所述第二反相器的輸入端連接；
所述第二晶體管的柵極與所述第一節(jié)點連接，所述第二晶體管的第一極與所述第二電源端連接，所述第二晶體管的第二極與所述第二反相器的輸入端連接；
所述第二反相器的輸出端與所述第二節(jié)點連接。
5.根據(jù)權利要求1所述的移位寄存器單元，其特征在于，所述控制子模塊還分別與所述第一電源端和所述第二電源端連接，所述控制子模塊，包括：第三反相器、第三晶體管、第四晶體管、第五晶體管以及第六晶體管，其中所述第三晶體管與所述第四晶體管的極性相同，所述第五晶體管與所述第六晶體管的極性相同，所述第三晶體管與所述第五晶體管的極性相反；
所述第三反相器的輸入端與所述第二節(jié)點連接，所述第三反相器的輸出端與所述第六晶體管的柵極連接；
所述第三晶體管的柵極與所述第三節(jié)點連接，所述第三晶體管的第一極與所述第五晶體管的第二極連接，所述第三晶體管的第二極與所述第一電源端連接；
所述第四晶體管的柵極與所述第五晶體管的第二極連接，所述第四晶體管的第一極與所述第一電源端連接，所述第四晶體管的第二極與所述第三節(jié)點連接；
所述第五晶體管的柵極與所述第二節(jié)點連接，所述第五晶體管的第一極與所述第二電源端連接；
所述第六晶體管的第一極與所述第三節(jié)點連接，所述第六晶體管的第二極與所述第二電源端連接。
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