[發明專利]一種擴展FPGA存儲資源的方法在審
| 申請號： | 201710150790.5 | 申請日： | 2017-03-14 |
| 公開（公告）號： | CN106933757A | 公開（公告）日： | 2017-07-07 |
| 發明（設計）人： | 周玉龍;童元滿;劉同強;劉剛 | 申請（專利權）人： | 鄭州云海信息技術有限公司 |
| 主分類號： | G06F13/16 | 分類號： | G06F13/16 |
| 代理公司： | 濟南信達專利事務所有限公司37100 | 代理人： | 劉繼枝 |
| 地址： | 450000 河南省鄭州市*** | 國省代碼： | 河南;41 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 擴展 fpga 存儲 資源 方法 | ||
1.一種擴展FPGA存儲資源的方法，其特征在于，該步驟如下：
步驟1）在系統中配置FPGA1芯片模塊，并通過高速接口與FPGA0芯片模塊的高速接口連接；
步驟2）根據系統設計要求，將中間狀態信息存儲到RAM0當中；
步驟3）將RAM0中的數據通過高速接口傳輸到FPGA1芯片模塊當中；
步驟4）在FPGA1芯片模塊當中，通過高速接口將數據解析出來；
步驟5）通過數據提取模塊將數據提取出來，然后存儲到RAM1當中；
步驟6）通過讀寫控制選擇模塊，由I2C接口將數據從RAM中讀出。
2.根據權利要求1所述的一種擴展FPGA存儲資源的方法，其特征在于，所述的步驟1）中的FPGA1芯片模塊中預先配置RAM1、數據提取模塊和讀寫控制選擇模塊。
3.一種擴展FPGA存儲資源的系統，其特征在于，包括FPGA0芯片模塊、FPGA1芯片模塊、數據提取模塊和讀寫控制選擇模塊；
所述的FPGA0芯片模塊中配置RAM0和高速接口；
所述的FPGA1芯片模塊中配置高速接口、數據提取模塊、RAM1、讀寫控制選擇模塊和I2C接口；
所述的FPGA0芯片模塊和FPGA1芯片模塊之間的數據通過高速接口傳輸。
4.根據權利要求3所述的一種擴展FPGA存儲資源的系統，其特征在于，所述的RAM0用于存儲中間數據信息并傳輸數據信息。
5.根據權利要求3所述的一種擴展FPGA存儲資源的系統，其特征在于，所述的高速接口用于完成FPGA0芯片模塊和FPGA1芯片模塊之間數據信息的傳輸接口。
6.根據權利要求3所述的一種擴展FPGA存儲資源的系統，其特征在于，所述的數據提取模塊配置于FPGA1芯片模塊中并提取從高速接口傳輸的數據信息。
7.根據權利要求3所述的一種擴展FPGA存儲資源的系統，其特征在于，所述的RAM1用于儲存來自數據提取模塊的數據信息，并傳輸信息至讀寫控制選擇模塊。
8.根據權利要求3所述的一種擴展FPGA存儲資源的系統，其特征在于，所述的讀寫控制選擇模塊用于數據信息的讀寫控制和數據信息讀寫的選擇，并將數據信息通過I2C接口輸出。
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