[發明專利]移位寄存器單元、驅動方法、柵極驅動電路和顯示裝置在審
| 申請號: | 201710028872.2 | 申請日: | 2017-01-16 |
| 公開(公告)號: | CN106652876A | 公開(公告)日: | 2017-05-10 |
| 發明(設計)人: | 樊君 | 申請(專利權)人: | 京東方科技集團股份有限公司;鄂爾多斯市源盛光電有限責任公司 |
| 主分類號: | G09G3/20 | 分類號: | G09G3/20;G11C19/28 |
| 代理公司: | 北京銀龍知識產權代理有限公司11243 | 代理人: | 許靜,劉偉 |
| 地址: | 100015 *** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 移位寄存器 單元 驅動 方法 柵極 電路 顯示裝置 | ||
技術領域
本發明涉及顯示驅動技術領域,尤其涉及一種移位寄存器單元、驅動方法、柵極驅動電路和顯示裝置。
背景技術
在現有技術中,當未對柵極驅動電路進行初始化的操作時,會由于電路相關節點狀態未知會導致電路初始工作時,由于電容耦合作用,導致一些節點的輸出電壓異常,進一步導致柵極電壓的誤開啟。由于柵極驅動電路包括的第N級移位寄存器單元(N為正整數)的上拉節點由于處于浮空狀態,所以該第N級移位寄存器單元的柵極驅動信號輸出端OUT_N跟隨時鐘信號耦合有輸出信號,但是輸出電平可能只有2V~3V左右,由于超過了下一級移位寄存器單元包括的輸入晶體管的閾值電壓電壓,會導致下一級移位寄存器單元中的上拉節點的電位被拉高拉高,會導致下一級移位寄存器單元的柵極驅動信號輸出端OUT_N+1誤輸出高電平。
發明內容
本發明的主要目的在于提供一種移位寄存器單元、驅動方法、柵極驅動電路和顯示裝置,解決現有技術中由于未對柵極驅動電路進行初始化的操作時,會由于電路相關節點狀態未知會導致電路初始工作時,由于電容耦合作用,導致一些節點的輸出電壓異常,進一步導致柵極電壓的誤開啟的問題。
為了達到上述目的,本發明提供了一種移位寄存器單元,包含于一柵極驅動電路中,該柵極驅動電路與一起始信號輸入端連接,所述移位寄存器單元包括輸入端、復位端和柵極驅動信號輸出端,所述移位寄存器單元還包括:
輸出模塊,分別與上拉節點、下拉節點、柵極驅動信號輸出端、第一時鐘信號輸出端和低電平輸出端連接;
輸出控制模塊,分別與輸入端、復位端、上拉節點、下拉節點和第二時鐘信號輸出端連接;以及,
初始化模塊,與初始化控制信號輸出端連接,用于在每一顯示周期開始時,在所述起始信號輸入端輸入起始信號之前,控制所述初始化控制信號輸出端輸出初始化控制信號,以使得所述上拉節點的電位為第一電平,以對所述上拉節點進行放噪。
實施時,所述初始化模塊包括:初始化晶體管,柵極與所述初始化控制信號輸出端連接,第一極與所述上拉節點連接,第二極與第一電平輸出端連接。
實施時,所述輸出控制模塊包括:上拉節點控制子模塊,分別與輸入端、復位端、上拉節點和下拉節點連接,用于當所述下拉節點的電位為第二電平時控制所述上拉節點和所述第一電平輸出端連接;以及,下拉節點控制子模塊,分別與所述上拉節點、所述下拉節點、第二時鐘信號輸出端和第一電平輸出端連接;
所述初始化模塊還與所述下拉節點連接,用于在每一顯示周期開始時,在所述起始信號輸入端輸入起始信號之前,控制所述初始化控制信號輸出端輸出初始化控制信號,以使得所述下拉節點的電位為第二電平,從而通過所述下拉節點控制子模塊控制所述下拉節點的電位為第一電平。
實施時,所述初始化模塊包括:初始化晶體管,柵極與所述初始化控制信號輸出端連接,第一極與所述下拉節點連接,第二極與所述初始化控制信號輸出端連接。
實施時,所述下拉節點控制子模塊用于當所述第二時鐘信號輸出端輸出第二電平時控制所述下拉節點與所述第二時鐘信號輸出端連接,當所述上拉節點的電位為第二電平時控制所述下拉節點與所述第一電平輸出端連接。
實施時,所述下拉節點控制子模塊包括:
第一下拉節點控制晶體管,柵極和第一極都與所述第二時鐘信號輸出端連接,第二極與所述下拉節點連接;
第二下拉節點控制晶體管,柵極與所述上拉節點連接,第一極與所述下拉節點連接,第二極與所述第一電平輸出端連接;以及,
下拉電容,第一端與所述下拉節點連接,第二端與所述第一電平輸出端連接。
實施時,所述上拉節點控制子模塊還分別與第一電平輸出端和第二電平輸出端連接,用于在輸入階段在所述輸入端接入的輸入信號的控制下控制所述上拉節點與所述第二電平輸出端連接,在輸出階段控制自舉拉升所述上拉節點的電位,在復位階段在所述復位端接入的復位信號的控制下控制所述上拉節點與第一電平輸出端連接。
實施時,所述上拉節點控制子模塊包括:
輸入晶體管,柵極與輸入端連接,第一極與所述第二電平輸出端連接,第二極與所述上拉節點連接;
復位晶體管,柵極與復位端連接,第一極與所述上拉節點連接,第二極與所述第一電平輸出端連接;
存儲電容,第一端與所述上拉節點連接,第二端與所述柵極驅動信號輸出端連接;以及,
上拉節點控制晶體管,柵極與所述下拉節點連接,第一極與所述上拉節點連接,第二極與所述第一電平輸出端連接。
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