[發明專利]集成電路的設計方法及裝置有效
| 申請號: | 201611078574.6 | 申請日: | 2016-11-29 |
| 公開(公告)號: | CN106611084B | 公開(公告)日: | 2020-12-18 |
| 發明(設計)人: | 秦海陽;李巖;陳廣緣 | 申請(專利權)人: | 北京集創北方科技股份有限公司 |
| 主分類號: | G06F30/373 | 分類號: | G06F30/373;G06F30/396;G06F30/3953;G06F30/398 |
| 代理公司: | 北京成創同維知識產權代理有限公司 11449 | 代理人: | 蔡純;張靖琳 |
| 地址: | 100176 北京市大*** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 集成電路 設計 方法 裝置 | ||
1.一種集成電路的設計方法,包括:
定時檢測前端文件的更新情況;
在所述前端文件有更新的情況下,根據所述前端文件以預定的執行方式通過后端設計工具執行預定的數字后端設計流程,從而更新集成電路的設計,
其中,所述預定的數字后端設計流程包括初始設計。
2.根據權利要求1所述的方法,其中,所述以預定的執行方式通過后端設計工具執行預定的數字后端設計流程包括:
在所述預定的執行方式為第一方式的情況下,通過所述后端設計工具執行所述預定的數字后端設計流程后打開所述后端設計工具的圖形用戶界面;
在所述預定的執行方式為第二方式的情況下,通過所述后端設計工具執行所述預定的數字后端設計流程后繼續定時檢測所述前端文件的更新情況。
3.根據權利要求1或2所述的方法,其中,所述預定的數字后端設計流程包括以下順序的任一步驟及所述任一步驟之前的所有步驟:
初始設計;
標準單元布局和優化;
時鐘樹綜合和優化;
時鐘樹布線和優化;
信號線布線;
信號線布線優化;
完成芯片設計;
輸出結果。
4.根據權利要求3所述的方法,其中,所述定時檢測前端文件的更新情況包括:
每間隔預定時間執行更新指令,將所述前端文件更新至版本庫中對應的最新版本,得到執行結果信息,如果所述執行結果信息中存在數據更新的標志,則判定所述前端文件有更新。
5.根據權利要求4所述的方法,其中,所述后端設計工具包括集成電路編譯器ICCompiler。
6.根據權利要求5所述的方法,其中,所述通過后端設計工具執行預定的數字后端設計流程包括:
在工具命令命令語言TCL解釋器中,使用循環語句調用gmake命令執行與所述預定的數字后端設計流程中各個步驟對應的工具命令語言TCL腳本文件,以通過集成電路編譯器ICCompiler執行預定的數字后端設計流程。
7.根據權利要求6所述的方法,其中,
在所述執行方式為第一方式的情況下,不執行與所述各個步驟中最后一個步驟對應的工具命令語言TCL腳本文件中的退出命令,僅執行與其他步驟對應的工具命令語言TCL腳本文件中的退出命令;
在所述執行方式為第二方式的情況下,執行與所述各個步驟對應的工具命令語言TCL腳本文件中的退出命令,在接收到預定指令的情況下,終止所述循環語句的執行。
8.根據權利要求6所述的方法,其中,在所述使用循環語句調用gmake命令之前,刪除執行gmake命令所產生的對應于所述各個步驟的文件。
9.一種集成電路的設計裝置,包括:
檢測模塊,用于定時檢測前端文件的更新情況;
執行模塊,用于在所述前端文件有更新的情況下,根據所述前端文件以預定的執行方式通過后端設計工具執行預定的數字后端設計流程,從而更新集成電路的設計,
其中,所述預定的數字后端設計流程包括初始設計。
10.根據權利要求9所述的裝置,其中,所述執行模塊包括:
第一執行單元,用于在所述預定的執行方式為第一方式的情況下,通過所述后端設計工具執行所述預定的數字后端設計流程后打開所述后端設計工具的圖形用戶界面;
第二執行單元,用于在所述預定的執行方式為第二方式的情況下,通過所述后端設計工具執行所述預定的數字后端設計流程后繼續定時檢測所述前端文件的更新情況。
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