[發明專利]一種基于射頻信號的多通道射頻信號延遲裝置及方法在審
| 申請號: | 201610786335.X | 申請日: | 2016-08-31 |
| 公開(公告)號: | CN106647432A | 公開(公告)日: | 2017-05-10 |
| 發明(設計)人: | 賀金龍;聶孝亮;馬孝尊;傅亦源;趙宏宇 | 申請(專利權)人: | 中國人民解放軍63892部隊 |
| 主分類號: | G05B19/042 | 分類號: | G05B19/042 |
| 代理公司: | 洛陽市凱旋專利事務所41112 | 代理人: | 陸君 |
| 地址: | 471003 *** | 國省代碼: | 河南;41 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 基于 射頻 信號 通道 延遲 裝置 方法 | ||
技術領域
本發明涉及射頻信號操作裝置技術領域,尤其涉及一種基于射頻信號的多通道射頻信號延遲裝置及方法。
背景技術
目前,公知的射頻信號延遲裝置是通過射頻開關對射頻信號脈沖進行截斷的方式,即改變射頻信號前沿位置進而改變了射頻脈沖寬度的方式實現,而不具有保證射頻信號脈沖完整性的信號延遲功能,基于同軸電纜實現的延遲裝置由于受限于同軸電纜射頻信號衰減量大的問題,存在延遲時間不夠長的問題。
發明內容
為克服現有射頻信號延遲裝置在保證射頻信號脈沖完整性及延遲時間長度方面存在的技術不足,本發明提供一種基于射頻信號的多通道射頻信號延遲裝置及方法,能夠根據用戶命令對射頻信號進行延時操作,而不會對射頻信號脈沖完整性產生影響的裝置,具有保持射頻脈沖信號脈沖的完整性的特性,結構簡單,延遲時間長度大,并調試具有手動操作、數字顯示、計算機遠控操作功能。
為了達到上述目的,本發明采用如下技術方案:
一種基于射頻信號的多通道射頻信號延遲裝置,包括若干單通道的射頻信號延遲裝置,單通道的射頻信號延遲裝置包括:控制器模塊1、延遲電路模塊2、數字顯示模塊3、手控開關模塊4、地址編碼模塊5、電源模塊6、遠控接口模塊7,所述控制器模塊1的控制端通過接口電路與連接射頻電路的延遲電路模塊2相連,控制器模塊1的輸出端口與數字顯示模塊3相連,控制器模塊1的輸入端分別與手控開關模塊4、編碼模塊5相連,控制器模塊1的電源端通過電源線與 電源模塊6相連,控制器模塊1上設置有與計算機遠程控制操作的遠控接口模塊7,采用RS-232或RS-485接口(不限于)。
所述的控制器模塊1為對延遲電路完成射頻信號延遲操作的單片計算機,或ARM芯片,或FPGA芯片。
所述手控開關模塊4包括通道選擇、單通道延遲量增加、單通道延遲量減小,全部通道延遲量增加、全部通道延遲量減小開關。
所述的數字顯示模塊為逐個顯示通道編號、通道延遲量值、及與上位控制計算機進行信息交互的顯示器。
所述的延遲電路為步進控制各通道延遲量,隨著延遲電路位數增加,實現更大范圍的延遲控制功能的電路,包括射頻電信號到射頻光信號的電光轉換電路、光開關、延遲光纖、直通光纖、光信號到電信號的光電轉換電路,連接射頻信號輸入端的電光轉換電路通過串聯的光纖開關電路與連接射頻信號輸出端的光電轉換電路相連,且每個開關電路分別與連接控制器模塊1的接口電路相連;所述串聯的光纖開關電路由若干開關電路分別通過延遲光纖、直通光纖串聯連接構成。
所述的五個單通道的射頻信號延遲裝置組成的通道射頻信號延遲裝置包括:控制器模塊1、延遲電路模塊2、數字顯示模塊3、手控開關模塊4、地址編碼模塊5、電源模塊6、遠控接口模塊7,所述控制器模塊1的控制端分別通過多個接口電路與連接多個射頻電路的延遲電路模塊2相連,控制器模塊1的視頻端通過視頻線與數字顯示模塊3相連,控制器模塊1的輸入端分別與手控開關模塊4、編碼模塊5相連,控制器模塊1的電源端通過電源線與電源模塊6相連,控制器模塊1上設置有與計算機遠程控制操作的遠控接口模塊7。
由于采用如上所述的技術方案,本發明具有如下優越性:
一種基于光纖多通道的射頻信號延遲裝置,能夠根據用戶的應用需求,對輸入的射頻信號進行延遲操作。用戶可以就近通過手動設置開關調整各通道射頻信號的延遲量,通過數字顯示方式了解各通道當 前延遲量值,或通過計算機遠程對各通道的延遲量進行控制設置。
附圖說明
圖1為單通道射頻信號數控延遲裝置的結構示意圖;
圖2為基于光纖實現的四位延遲電路的結構示意圖;
圖3為五通道基于光纖的射頻信號數控延遲裝置的結構示意圖。
圖4是基于射頻電纜實現的四位延遲電路圖。
具體實施方式
以下結合附圖和實施例用于進一步說明本裝置的功能與結構,但不用來限制本發明的范圍。
實施方式一
參見圖1,一種單通道的射頻信號延遲控制裝置,其結構包括七個模塊,分別是控制器模塊1、延遲電路模塊2、數字顯示模塊3、手控開關模塊4、地址編碼模塊5、電源模塊6、遠控接口模塊7,各模塊的功能如下。
模塊1:控制器,是本裝置的核心模塊,由單片計算機或ARM芯片或FPGA芯片構成,包括對其編程,接收用戶的手動操作或計算機命令操作,對通過延遲電路控制接口電路對延遲電路進行控制設置,并通過數字顯示模塊顯示當前通道號與通道的延遲量值。
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