[發明專利]共模噪聲抑制電路、差分信號發送裝置、差分信號傳輸系統及車載電子設備無效
| 申請號: | 201410205593.5 | 申請日: | 2014-05-15 |
| 公開(公告)號: | CN104168010A | 公開(公告)日: | 2014-11-26 |
| 發明(設計)人: | 武田憲明 | 申請(專利權)人: | 松下電器產業株式會社 |
| 主分類號: | H03K19/0175 | 分類號: | H03K19/0175;H03K17/687 |
| 代理公司: | 永新專利商標代理有限公司 72002 | 代理人: | 徐殿軍 |
| 地址: | 日本*** | 國省代碼: | 日本;JP |
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| 摘要: | |||
| 搜索關鍵詞: | 噪聲 抑制 電路 信號 發送 裝置 傳輸 系統 車載 電子設備 | ||
技術領域
本公開涉及抑制從例如液晶顯示器等顯示裝置與圖像處理LSI之間的圖像數據通信接口等產生的共模噪聲的共模噪聲抑制電路、具有該共模噪聲控制電路的差分信號發送裝置、具有該差分信號發送裝置的差分信號傳輸系統、以及具有該差分信號傳輸系統的車載電子設備。?
背景技術
隨著數字影像技術的發展,在以智能電話和平板設備等為代表的移動設備中也能夠視聽高畫質的動態圖像。這些小型且高畫質的顯示設備開始被用作車載設備,也開始被應用于導航系統、電影欣賞等用的車內娛樂、速度計或燃料計、顯示行駛距離等汽車的行駛所需要的信息的儀表盤中。另外,正在積極開發平視顯示器等將圖像投影在前風擋玻璃前方進行觀察的技術等,以便使駕駛員不移動視線即可得到必要的信息。?
另一方面,為了實現這種高畫質的圖像顯示,需要向顯示設備發送大量的圖像數據,進行顯示設備與圖像處理LSI之間的數據通信的接口的數據通信帶寬日趨增加。由于通信帶寬的增加,以這些顯示設備與圖像處理LSI之間的接口為原因而產生的電磁輻射噪聲將不能再被忽視,電磁輻射噪聲的抑制成為重大的技術課題,尤其是在車載設備中從安全性角度考慮需要設計嚴格的標準等。?
通常,顯示設備與圖像處理LSI之間的接口采用以LVDS(Low?Voltage?Differential?Swing:低電壓差分變動)等為代表的小振幅的差分(differential)接口。如廣為公知的那樣,能夠將通過以差分對來傳遞信號而產生的磁場抵消,以減輕電磁輻射的影響。雖然能夠這樣消除差分成分(differential?mode)的電磁輻射,但是共模(同相成分)不能消除,并成為電磁輻射的原因。雖然能夠在接收端將共模電壓控制為一定值,但是在發送設備生成?數據時而進行的開關時產生的開關噪聲等被變換為共模,并作為共模噪聲而表現出來。這些發送設備的開關的頻度及速度隨著傳輸帶寬的增加而增加,并成為電磁輻射噪聲增加的原因。?
在過去的共模噪聲抑制電路中,基于降低開關噪聲的目的,根據晶體管的極性來優化構成開關的晶體管的控制信號(例如,參照專利文獻1)。?
【現有技術文獻】?
【專利文獻】?
【專利文獻1】日本特開2012-105135號公報?
發明概要?
發明要解決的問題?
但是,在前述現有技術的結構中,為了限制晶體管的輸入信號電平,必須增大晶體管尺寸來流過必要的電流,其結果是存在如下問題,即晶體管的寄生電容成分增大,阻礙了快速動作。?
發明內容
本公開正是為了解決上述現有技術的問題而提出的,其目的在于,在不阻礙快速動作的情況下抑制共模噪聲。?
用于解決問題的手段?
為了解決前述現有技術的問題,本發明的共模噪聲抑制電路是發送信號輸出電路用的共模噪聲抑制電路,該發送信號輸出電路具有第1及第2輸出端子,從第1及第2輸出端子發送差分信號,所述共模噪聲抑制電路具有:第1產生電路,產生用于在第1輸出端子插入電流或者抽出電流的電流;第2產生電路,產生用于在第2輸出端子插入電流或者抽出電流的電流;以及控制電路,控制第1及第2產生電路,以便與發送信號輸出電路的驅動控制時鐘同步地生成用于抑制所發送的差分信號的共模噪聲的電流脈沖。?
發明效果?
根據本發明的共模噪聲抑制電路,能夠在不阻礙快速動作的情況下抑制共模噪聲。?
附圖說明
圖1是表示本發明的實施方式1的差分信號傳輸系統的結構的框圖。?
圖2是表示圖1的差分信號發送裝置1的共模噪聲抑制電路11及發送信號輸出電路12的結構的電路圖。?
圖3A是表示圖2的電流脈沖產生電路16的結構例的電路圖。?
圖3B是表示圖2的電流脈沖產生電路16的第1變形例即電流脈沖產生電路16A的結構例的電路圖。?
圖3C是表示圖2的電流脈沖產生電路16的第2變形例即電流脈沖產生電路16B的結構例的電路圖。?
圖4是表示圖1和圖2的控制電路15的結構的框圖。?
圖5A是表示圖4的控制脈沖產生電路41、42、43、44的結構的框圖。?
圖5B是表示圖5A的控制脈沖產生電路41、42、43、44的動作例的時序圖。?
圖6是表示圖5A的可變延遲電路48的結構的電路圖。?
圖7是表示在圖1的表存儲器18中存儲的開關控制表的圖。?
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