[發明專利]多線程處理器的線程取指調度方法、系統和多線程處理器有效
| 申請號: | 201310295546.X | 申請日: | 2013-07-15 |
| 公開(公告)號: | CN104298552B | 公開(公告)日: | 2018-06-19 |
| 發明(設計)人: | 李曄;侯銳;馮煜晶;王曦爽 | 申請(專利權)人: | 華為技術有限公司;中國科學院計算技術研究所 |
| 主分類號: | G06F9/48 | 分類號: | G06F9/48;G06F9/50 |
| 代理公司: | 深圳市深佳知識產權代理事務所(普通合伙) 44285 | 代理人: | 唐華明 |
| 地址: | 518129 廣東*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關鍵詞: | 取指 多線程處理器 指令 線程 第一線 調度 處理器功耗 處理器技術 改變指令 目標地址 取指單元 | ||
1.一種多線程處理器的線程取指調度方法,其特征在于,包括:
為第一線程進行取指,將取到的指令放入所述第一線程的指令緩沖隊列中;
判斷當前取到的指令是否包括第一類指令,如果是,暫停為所述第一線程在所述第一類指令之后的取指;所述第一類指令為能改變指令流且無法預知目標地址的指令。
2.根據權利要求1所述的方法,其特征在于,在所述為第一線程進行取指之前,所述方法還包括:
在指令進入指令緩存之前,對指令進行預譯碼,將其中的第一類指令打上標記。
3.根據權利要求2所述的方法,所述判斷當前取到的指令是否包括第一類指令包括:
判斷所述當前取到的指令是否包括帶有標記的指令。
4.根據權利要求1至3任一項所述的方法,其特征在于,所述暫停對所述第一線程在所述第一類指令之后的取指包括:將所述第一線程的準備好ready標識置為無效和/或將降低所述第一線程的取指調度優先級。
5.根據權利要求4所述的方法,其特征在于,所述方法還包括:
判斷所述第一類指令是否執行完畢,如果是,將所述第一線程的準備好ready標識置為有效和/或將提高所述第一線程的取指調度優先級。
6.一種多線程處理器的線程取指調度系統,其特征在于,包括:
取指單元,用于為第一線程進行取指,將取到的指令放入所述第一線程的指令緩沖隊列中;
第一判斷單元,用于判斷當前取到的指令是否包括第一類指令;所述第一類指令為能改變指令流且無法預知目標地址的指令;
所述取指單元,還用于當所述第一判斷單元的判斷結果為是時,暫停為所述第一線程在所述第一類指令之后的取指。
7.根據權利要求6所述的系統,其特征在于,所述系統還包括:
預譯碼單元,用于在指令進入指令緩存之前,對指令進行預譯碼,將第一類指令打上標記。
8.根據權利要求7所述的系統,其特征在于,所述第一判斷單元具體用于判斷所述當前取到的指令是否包括帶有標記的指令。
9.根據權利要求6至8任一項所述的系統,其特征在于,所述取指單元具體用于當所述第一判斷單元的判斷結果為否時,將所述第一線程的準備好ready標識置為無效和/或降低所述第一線程的取指調度優先級。
10.根據權利要求9所述的系統,其特征在于,所述系統還包括:
第二判斷單元,用于判斷所述第一類指令是否執行完畢;
所述取指單元還用于當所述第二判斷單元的判斷結果為是,將所述第一線程的準備好ready標識置為有效和/或提高所述第一線程的取指調度優先級。
11.一種多線程處理器,其特征在于,所述多線程處理器包括如權利要求6-10任一項所述的多線程處理器的線程取指調度系統。
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