[實用新型]一種用于數字電視前端的四路集成式衛星碼流接收機有效
| 申請號: | 201220121455.5 | 申請日: | 2012-03-28 |
| 公開(公告)號: | CN202496031U | 公開(公告)日: | 2012-10-17 |
| 發明(設計)人: | 鐘志靖;閻俐華;瞿強 | 申請(專利權)人: | 成都杰翔科技有限公司 |
| 主分類號: | H04N21/222 | 分類號: | H04N21/222;H04N21/226 |
| 代理公司: | 暫無信息 | 代理人: | 暫無信息 |
| 地址: | 610051 四川省成都市*** | 國省代碼: | 四川;51 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 用于 數字電視 前端 四路 集成 衛星 接收機 | ||
技術領域
本實用新型屬于廣播電視衛星碼流接收設備領域,具體涉及一種用于數字電視前端的四路集成式衛星碼流接收機。
背景技術
在數字電視前端系統搭建中,往往采用單路衛星碼流接收機對衛星上的免費節目進行接收并進行數字碼流(TS)轉換,它是搭建系統的重要設備之一,單臺接收機只能接收一個衛星下行頻率的節目包,在基于DVB-C的數字電視傳輸系統中,組成一個數字電視傳輸節目包一般需4臺以上的衛星碼流接收機同時工作,轉換后的碼流(TS)信號進入復用器打包處理生成一路符合DVB-C系統標準(ISO/IEC13818)的傳輸流(TS)輸出。這種系統配置架構往往會造成工程施工復雜,機架上設備太多,耗電量大,維護調試麻煩等缺點。
為了解決現有技術中的上述不足,本實用新型提供了一種新的解決方案。
實用新型內容
本實用新型要解決的技術問題是:針對于現有技術的不足,提供一種可以同時接收四個衛星下行頻率的四路集成式衛星碼流接收機。
為達到上述發明目的,本實用新型所采用的技術方案為:提供一種用于數字電視前端的四路集成式衛星碼流接收機,包括機體,其特征在于:所述機體內設置有四個高頻頭模塊、CPLD碼流處理模塊、嵌入式CPU控制模塊、開關電源模塊,所述機體的前面板上設有液晶顯示屏和鍵盤;
所述四個高頻頭模塊分別為通道一高頻頭模塊、通道二高頻頭模塊、通道三高頻頭模塊、通道四高頻頭模塊,所述每個通道的高頻頭模塊分別設有RF輸入/輸出端口,所述CPLD碼流處理模塊設有TS流輸出端口,每個通道的高頻頭模塊分別通過RF輸入/輸出端口與衛星天線連接,每個通道的高頻頭模塊的并行TS流信號輸出端與CPLD碼流處理模塊的輸入端連接,每個通道的高頻頭模塊分別通過數據控制總線與嵌入式CPU控制模塊連接;所述液晶顯示屏和鍵盤分別與CPU控制模塊連接。
所述高頻頭模塊為可直接解調出符合DVB標準的并行TS數據流信號的GSNM-01R型高頻頭。
所述CPLD碼流控制模塊采用的芯片為MAXII系列可編程邏輯集成芯片EPM3064ATC44。
所述嵌入式CPU控制模塊采用的芯片為32位ARM核集成電路芯片LM3S6911。
所述液晶顯示屏為160×32點陣中英文液晶顯示屏,所述鍵盤為7×1矩陣鍵盤。
本實用新型所提供的用于數字電視前端的四路集成式衛星碼流接收機與現有技術相比,具有以下有益效果:
1)本實用新型通過設置四個高頻頭模塊,可以同時接收四個衛星下行頻率,本實用新型一臺就可以替換傳統的單路衛星碼流接收設備四臺,解決機架設備多的問題,大大減少機架設備占用空間。
2)本實用新型設置有160×32點陣中英文液晶顯示屏和鍵盤,所有四路衛星接收參數均可通過液晶顯示屏和鍵盤設置,操作簡單容易,大大減輕了本機維護的工作量。
3)本實用新型操作簡單,功耗小,性能穩定可靠,接收靈敏度高,性價比高,對信號源的要求大大降低,可廣泛用于各種CATV有線數字電視、MMDS數字電視前端等衛星節目碼流的接收處理。
附圖說明
圖1為用于數字電視前端的四路集成式衛星碼流接收機的整機原理結構圖。
具體實施方式
下面結合附圖對本實用新型的具體實施方式做詳細地描述:
如圖1所示,本實用新型用于數字電視前端的四路集成式衛星碼流接收機包括機體,所述機體內設置有四個高頻頭模塊、CPLD碼流處理模塊、嵌入式CPU控制模塊、開關電源模塊,所述機體的前面板上設有液晶顯示屏和鍵盤;
所述四個高頻頭模塊分別為通道一高頻頭模塊、通道二高頻頭模塊、通道三高頻頭模塊、通道四高頻頭模塊,所述每個通道的高頻頭模塊分別設有RF輸入/輸出端口,所述CPLD碼流處理模塊設有TS流輸出端口,每個通道的高頻頭模塊分別通過RF輸入/輸出端口與衛星天線連接,每個通道的高頻頭模塊的并行TS流信號輸出端與CPLD碼流處理模塊的輸入端連接,每個通道的高頻頭模塊分別通過數據控制總線與嵌入式CPU控制模塊連接;所述液晶顯示屏和鍵盤分別與CPU控制模塊連接。
所述高頻頭模塊為可直接解調出符合DVB標準的并行TS數據流信號的GSNM-01R型高頻頭。
所述CPLD碼流控制模塊采用的芯片為MAXII系列可編程邏輯集成芯片EPM3064ATC44。
所述嵌入式CPU控制模塊采用的芯片為32位ARM核集成電路芯片LM3S6911。
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