[發明專利]一種生成伽羅華域乘法器電路的方法及裝置在審
| 申請號： | 201210525538.5 | 申請日： | 2012-12-07 |
| 公開（公告）號： | CN103870239A | 公開（公告）日： | 2014-06-18 |
| 發明（設計）人： | 劉會娟;蘇志強 | 申請（專利權）人： | 北京兆易創新科技股份有限公司 |
| 主分類號： | G06F7/72 | 分類號： | G06F7/72 |
| 代理公司： | 北京安信方達知識產權代理有限公司 11262 | 代理人： | 栗若木;曲鵬 |
| 地址： | 100083 北京市海淀*** | 國省代碼： | 北京;11 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 生成 伽羅華域 乘法器 電路 方法 裝置 | ||
1.一種生成伽羅華域乘法器電路的方法，包括：
將進行乘法運算的兩個伽羅瓦域元素分別轉換為多項式；對轉換得到的兩個多項式進行實數域的多項式乘法，將乘法結果轉換為乘積多項式；
當上述兩個多項式中的一個已知時，將該多項式各系數的值代入所述乘積多項式，將所述乘積多項式轉換為另一個多項式的系數相加的轉換式；
根據該轉換式生成邏輯電路，具體包括：為所述轉換式中的多項式的系數各設立一個輸入端；為所述轉換式中的加運算各設立一個對應的門電路，各門電路的輸出端用于輸出該門電路兩個輸入端信號的加運算結果，將各門電路的兩個輸入端分別連接到該門電路所對應的加運算的加數和被加數。
2.如權利要求1所述的方法，其特征在于，將門電路的兩個輸入端分別連接到該門電路所對應的加運算的加數和被加數是指：
當該門電路所對應的加運算的加數/被加數為多項式的系數時，將門電路的相應輸入端連接到為該多項式的系數設立的輸入端；當該門電路所對應的加運算的加數/被加數為另一加運算的結果，將門電路的相應輸入端連接到為該另一加運算設立的門電路的輸出端。
3.如權利要求1所述的方法，其特征在于，在根據該轉換式生成邏輯電路的步驟后，還包括：將該邏輯電路轉換為硬件電路。
4.如權利要求1所述的方法，其特征在于：所述門電路為異或門。
5.一種生成伽羅華域乘法器電路的裝置，包括：
乘運算模塊，用于將進行乘法運算的兩個伽羅瓦域元素分別轉換為多項式；對轉換得到的兩個多項式進行實數域的多項式乘法，將乘法結果轉換為乘積多項式；
轉換模塊，用于當上述兩個多項式中的一個已知時，將該多項式各系數的值代入所述乘積多項式，將所述乘積多項式轉換為另一個多項式的系數相加的轉換式；
邏輯電路生成模塊，用于根據該轉換式生成邏輯電路，具體包括：為所述轉換式中的多項式的系數各設立一個輸入端；為所述轉換式中的加運算各設立一個對應的門電路，各門電路的輸出端用于輸出該門電路兩個輸入端信號的加運算結果，將各門電路的兩個輸入端分別連接到該門電路所對應的加運算的加數和被加數。
6.如權利要求5所述的裝置，其特征在于，所述邏輯電路生成模塊將門電路的兩個輸入端分別連接到該門電路所對應的加運算的加數和被加數是指：
所述邏輯電路生成模塊當該門電路所對應的加運算的加數/被加數為多項式的系數時，將門電路的相應輸入端連接到為該多項式的系數設立的輸入端；當該門電路所對應的加運算的加數/被加數為另一加運算的結果，將門電路的相應輸入端連接到為該另一加運算設立的門電路的輸出端。
7.如權利要求5所述的裝置，其特征在于，還包括：
硬件電路生成模塊，用于將所述邏輯電路轉換為硬件電路。
8.如權利要求5所述的裝置，其特征在于：所述門電路可以但不限于為異或門。
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