[發明專利]將數據寫入數據處理系統內的系統存儲器的方法和系統有效
| 申請號: | 201210188567.7 | 申請日: | 2012-06-08 |
| 公開(公告)號: | CN102841856B | 公開(公告)日: | 2017-05-03 |
| 發明(設計)人: | B·C·格雷森;W·T·錢戈瓦柴 | 申請(專利權)人: | 飛思卡爾半導體公司 |
| 主分類號: | G06F12/02 | 分類號: | G06F12/02;G06F12/0893 |
| 代理公司: | 中國國際貿易促進委員會專利商標事務所11038 | 代理人: | 申發振 |
| 地址: | 美國得*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 數據 寫入 數據處理系統 系統 存儲器 | ||
技術領域
本公開內容一般地涉及數據處理系統,并且更特別地,涉及將數據回寫到數據處理系統內的系統存儲器。
背景技術
在多個處理器正訪問共用的系統存儲器的典型的多處理器系統中,數據以時間交替的方式寫入存儲器。這可能導致非最優的性能。例如,在雙倍數據率(DDR)存儲器的情形中,每當數據被寫入存儲體(memory bank)的不同頁時,必須執行附加的頁打開(page-open)和頁關閉(page-close),從而降低了整體系統性能。
發明內容
在一個實施例中,本發明提供了一種將數據寫入數據處理系統內的系統存儲器的方法。該方法包括:將與緩存行關聯的狀態指示符存儲于與系統存儲器的區域關聯的跟蹤條目內。其中所述緩存行是各自與系統存儲器的所述區域的相應的獨特部分關聯的多個緩存行之一,其中所述多個緩存行包括N個緩存行,其中N是存儲系統存儲器的全部所述區域所需的緩存行的數量。所述狀態指示符是各自與所述多個緩存行中的相應的緩存行關聯的多個狀態指示符之一,使得所述多個緩存行中的每個緩存行具有所述多個狀態指示符中的相關的狀態指示符。所述跟蹤條目包括:所述多個狀態指示符中的每一個,其中每個狀態指示符包括:在相關的緩存行是用于將存儲于所述緩存行內的數據寫入系統存儲器的所述區域的所述關聯部分的候選者時的未清理指示,以及在相關的緩存行不是用于將存儲于所述緩存行內的數據寫入系統存儲器的所述區域的所述關聯部分的候選者時的清理指示。該方法還包括:確定系統存儲器的所述區域包括的所述未清理指示的所述多個狀態指示符的數量,以及如果所確定的未清理指示的數量超過了閾值,則選擇緩存行,將所述存儲于所述緩存行內的數據寫入系統存儲器的所述區域的所述關聯部分,以及將清理指示存儲于與所述緩存行對應的所述狀態指示符內,其中所述清理指示識別出所述緩存行不是用于將存儲于所述緩存行內的數據寫入系統存儲器的所述區域的所述關聯部分的候選者。
附圖說明
本發明通過實例的方式來說明,并且不受附圖所限定,在附圖中相似的參考符號指示相似的元件。附圖中的元件僅出于簡單和清晰起見而示出,而不一定按比例繪制。
圖1以框圖形式示出了根據本發明的一個實施例的數據處理系統。
圖2以框圖形式示出了根據本發明的一個實施例的圖1的系統存儲器。
圖3以框圖形式示出了根據本發明的一個實施例的圖1的系統緩存(cache)。
圖4以框圖形式示出了根據本發明的一個實施例的圖1的緩存清理電路。
圖5以圖表形式示出了根據本發明的一個實施例的在圖1的數據處理系統內所提供的訪問地址。
圖6以圖表形式示出了根據本發明的一個實施例的圖1的緩存清理電路的跟蹤條目。
圖7以流程圖形式示出了根據本發明的一個實施例的用于更新圖1的緩存清理電路的方法。
圖8以流程圖形式示出了根據本發明的一個實施例的用于執行緩存清理的方法。
具體實施方式
對存儲器的同一區域的存儲訪問可以幫助減少由于必須連續地訪問不同的區域所引起的延遲。例如,在DDR存儲器的情形中,每當發生必須關閉當前行并且激活或打開新的行的行沖突時,延遲由于行的每次關閉和打開而產生。因此,在一個實施例中,對系統存儲器的區域的存儲訪問被跟蹤以確定與存儲器的同一區域對應的未清理緩存行(dirty cache line)的數量何時已達到預定的閾值。在達到該閾值時,那些與同一區域對應的未清理緩存行能夠通過將所更新的緩存數據寫入系統存儲器來清理。由于這些未清理的緩存行對應于同一區域,因而在執行清理時不需要新區域的連續的關閉和打開。因此,雖然延遲可以由用于清理與同一區域對應的一組未清理緩存行的清理過程的第一次訪問所引起,但是該清理過程的后續訪問不會引起額外的延遲。以這種方式,可以提高系統的性能。
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