[發(fā)明專利]主控處理器和協(xié)處理器系統(tǒng)的通信方法、裝置、系統(tǒng)有效
| 申請?zhí)枺?/td> | 200910236000.0 | 申請日： | 2009-11-04 |
| 公開（公告）號： | CN101719115A | 公開（公告）日： | 2010-06-02 |
| 發(fā)明（設(shè)計）人： | 李棟梁;凌明;艾國 | 申請（專利權(quán)）人： | 北京中星微電子有限公司 |
| 主分類號： | G06F15/163 | 分類號： | G06F15/163 |
| 代理公司： | 北京銀龍知識產(chǎn)權(quán)代理有限公司 11243 | 代理人： | 許靜 |
| 地址： | 100083 北京市*** | 國省代碼： | 北京;11 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 主控 處理器 和協(xié) 系統(tǒng) 通信 方法 裝置 | ||
1.一種主控處理器和協(xié)處理器系統(tǒng)的通信方法，其特征在于，包括：
向協(xié)處理器系統(tǒng)發(fā)送功能指令時，將主控處理器的時鐘設(shè)置為與所述協(xié)處 理器系統(tǒng)的頻率相匹配；
將所述主控處理器的中斷觸發(fā)方式設(shè)置為與所述協(xié)處理器系統(tǒng)的中斷信 號給出方式相匹配；
查找所述功能指令對應(yīng)的功能編號；
將所述功能編號寫入?yún)f(xié)處理器系統(tǒng)中；
將執(zhí)行所述功能指令需要的數(shù)據(jù)寫入所述協(xié)處理器系統(tǒng)中；
向所述協(xié)處理器系統(tǒng)發(fā)送執(zhí)行所述功能指令的中斷信號。
2.根據(jù)權(quán)利要求1所述的主控處理器和協(xié)處理器系統(tǒng)的通信方法，其特 征在于，所述向所述協(xié)處理器系統(tǒng)發(fā)送執(zhí)行所述功能指令的中斷信號的步驟具 體為：
通過中斷線向所述協(xié)處理器系統(tǒng)發(fā)送執(zhí)行所述功能指令的中斷信號；或者
通過配置所述協(xié)處理器系統(tǒng)的寄存器，向所述協(xié)處理器系統(tǒng)發(fā)送執(zhí)行所述 功能指令的中斷信號。
3.根據(jù)權(quán)利要求1所述的主控處理器和協(xié)處理器系統(tǒng)的通信方法，其特 征在于，
所述協(xié)處理器系統(tǒng)包括：協(xié)處理器以及與所述協(xié)處理器連接的內(nèi)存；
所述將所述功能編號寫入所述協(xié)處理器系統(tǒng)中的步驟具體為：
將所述功能編號寫入所述協(xié)處理器的寄存器中或者寫入所述內(nèi)存中；
所述將執(zhí)行所述功能指令需要的數(shù)據(jù)寫入所述協(xié)處理器系統(tǒng)中的步驟具 體為：
將執(zhí)行所述功能指令需要的數(shù)據(jù)寫入所述協(xié)處理器的寄存器中或者寫入 所述內(nèi)存中；
所述通信方法還包括：將所述數(shù)據(jù)的地址寫入所述協(xié)處理器系統(tǒng)中，所述 將所述數(shù)據(jù)的地址寫入所述協(xié)處理器系統(tǒng)中的步驟具體為：
將所述數(shù)據(jù)的地址寫入?yún)f(xié)處理器的寄存器中或者寫入所述內(nèi)存中。
4.一種協(xié)處理器系統(tǒng)和主控處理器的通信方法，其特征在于，包括：
接收主控處理器發(fā)送的功能指令時，接收所述主控處理器的執(zhí)行所述功能 指令的中斷信號；
在所述協(xié)處理器系統(tǒng)中獲取所述功能指令對應(yīng)的功能編號；
在所述協(xié)處理器系統(tǒng)中獲取執(zhí)行所述功能指令需要的數(shù)據(jù)；
根據(jù)所述數(shù)據(jù)，執(zhí)行所述功能編號對應(yīng)的功能指令。
5.根據(jù)權(quán)利要求4所述的協(xié)處理器系統(tǒng)和主控處理器的通信方法，其特 征在于，在所述協(xié)處理器系統(tǒng)中獲取執(zhí)行所述功能指令需要的數(shù)據(jù)的步驟之 前，還包括：
在所述協(xié)處理器系統(tǒng)中獲取所述功能編號對應(yīng)的數(shù)據(jù)地址；
在所述協(xié)處理器系統(tǒng)中獲取執(zhí)行所述功能指令需要的數(shù)據(jù)的步驟具體為：
根據(jù)所述數(shù)據(jù)地址，在所述協(xié)處理器系統(tǒng)中獲取執(zhí)行所述功能指令需要的 數(shù)據(jù)。
6.根據(jù)權(quán)利要求5所述的協(xié)處理器系統(tǒng)和主控處理器的通信方法，其特 征在于，
所述協(xié)處理器系統(tǒng)包括：協(xié)處理器以及與所述協(xié)處理器連接的內(nèi)存；
所述在所述協(xié)處理器系統(tǒng)中獲取所述功能指令對應(yīng)的功能編號的步驟具 體為：
在所述協(xié)處理器的寄存器中或者內(nèi)存中獲取所述功能指令對應(yīng)的功能編 號；
所述在所述協(xié)處理器系統(tǒng)中獲取所述功能編號對應(yīng)的數(shù)據(jù)地址的步驟具 體為：
在所述協(xié)處理器的寄存器中或者內(nèi)存中獲取所述功能編號對應(yīng)的數(shù)據(jù)地 址；
所述在所述協(xié)處理器系統(tǒng)中獲取執(zhí)行所述功能指令需要的數(shù)據(jù)的步驟具 體為：
在所述協(xié)處理器的寄存器中或者內(nèi)存中獲取執(zhí)行所述功能指令需要的數(shù) 據(jù)。
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