[發明專利]基于FPGA的SDI數值誤碼檢測和校正算法有效
| 申請號： | 200910188002.7 | 申請日： | 2009-10-20 |
| 公開（公告）號： | CN101695135A | 公開（公告）日： | 2010-04-14 |
| 發明（設計）人： | 程鵬;張偉亭 | 申請（專利權）人： | 大連捷成實業發展有限公司 |
| 主分類號： | H04N7/64 | 分類號： | H04N7/64 |
| 代理公司： | 大連東方專利代理有限責任公司 21212 | 代理人： | 李猛 |
| 地址： | 116023 遼寧*** | 國省代碼： | 遼寧;21 |
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| 摘要： | |||
| 搜索關鍵詞： | 基于 fpga sdi 數值 檢測 校正 算法 | ||
【權利要求書】：
1.一種基于FPGA的SDI數值誤碼檢測和校正算法，其特征在于：它是通過以下步驟實現的：
首先對輸入的SDI信號進行解串得到時間基準信號SAV和EAV及相應的色度信號Cb、Cr和亮度信號Y的位置；
在SAV后面的有效視頻區內，判斷Y是否超出0x040～0x3AC的范圍，有則校正將其限制在規定范圍以內，然后判斷Cb、Cr是否超出0x040～0x3C0的范圍，有則校正將其限制在規定范圍以內；
在EAV后面的消隱區內首先判斷切換點之后的那一行是否有輔助數據包，有則解嵌再加嵌進行調整，無則不調整；
對消隱區內的輔助數據校驗和進行校驗，當發現錯誤時進行校正；
對消隱區內的非輔助數據判斷其處在Cb、Y、Cr、Y的位置，將其校正成黑電平的數值0x200、0x040、0x200、0x040；
對校正完成后的SDI加EDH校驗。
2.如權利要求1所述的基于FPGA的SDI數值誤碼檢測和校正算法，其特征在于：所述的切換點之后的那一行為625行系統的第7/320行，525行系統的第11/274行。
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