[發明專利]數字信號處理設備無效
| 申請號: | 01804625.8 | 申請日: | 2001-11-22 |
| 公開(公告)號: | CN1398369A | 公開(公告)日: | 2003-02-19 |
| 發明(設計)人: | F·佩斯索拉諾;J·L·W·科斯塞斯;A·M·G·皮特斯 | 申請(專利權)人: | 皇家菲利浦電子有限公司 |
| 主分類號: | G06F9/30 | 分類號: | G06F9/30;G06F9/38 |
| 代理公司: | 中國專利代理(香港)有限公司 | 代理人: | 吳立明,羅朋 |
| 地址: | 荷蘭艾*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 數字信號 處理 設備 | ||
本發明涉及執行多個操作的數字信號處理設備,該設備包括多個功能單元,其中每一個功能單元適合執行操作;和控制所述功能單元的控制裝置。另外,本發明涉及在數字信號處理設備中處理數字信號的方法,該數字信號處理設備包括多個功能單元,其中每一個功能單元適合執行操作。
通常在數字信號處理器(DSP)中實現這種設備和方法。為了提高它們的性能,該數字信號處理器包含若干通常運行在小循環中的處理單元。存在二種常規的解決方案,即:設置(1)VLIW處理器,該處理器包括若干功能單元和一個中央控制,以及(2)帶有協處理器的中央處理器,這些協處理器中的每一個自發進行固定功能。
EP?0?403?729?A2公開了一種數字信號處理設備,該設備包括二個或更多的與至少一個指令存儲器相關的地址寄存器、數據存儲器或系數存儲器、和二個或更多的與計算塊(computing?block)相關的數據寄存器。這些二個或更多的寄存器在由計算塊同時處理的不同作業之間被負載循環(duty?circle)切換以便能夠在作業的單芯片上進行有效處理,可以采用不同的處理速度處理這些作業,如適合高速或者低速處理的作業。
在美國加州,Los?Alamitons?2000年出版的“第六屆異步電路與系統高級研究討論會的會議錄”第176-186頁的會議論文(“proceedings?Sixth?International?Symposium?on?AdvancedResearch?in?Asynchronous?Circuits?and?System(ASYNC200)”(Cat.No?PR00586),published??2000?in?Los?Alamitos,CA,USA)中,Brackenbury描述了一種用于低功率異步數字信號處理器的結構,該處理器準備用于GSM(數字蜂窩電話)芯片組的目標應用。該結構的關鍵部分是一個指令緩沖器,該緩沖器既可以提供預取指令的存儲又可以進行硬件循環。這需要低的等待時間和合理快的循環時間,但是還必須適合低功率運行。在該論文中,提出了一種基于字片(word-slice)FIFO(先入先出)結構。這避免了與微線性流水線FIFO關聯的輸入等待和功率消耗,并且這種結構反應性容易地導致其本身所需的循環特性。該指令緩沖器的循環時間比微流水線FIFO大約慢三倍。但是,該指令緩沖器顯示出:每次操作的能量為微流水線結構(低得多的能力)的能量的48%-62%之間??誇IFO的輸入至輸出的等待比微流水線設計低10倍。
US?5,655,090?A公開了一種外部控制的數字信號處理器,該數字信號處理器設有進行異步操作并且獨立于系統環境的輸入/輸出FIFO。該系統結構包括:連接于第一FIFO緩沖器數據輸出與第二FIFO緩沖器數據輸出之間的數字信號處理裝置、控制數字信號處理裝置的控制裝置,該裝置對第一FIFO緩沖器和第二FIFO緩沖器中存有或者沒有數據和所接收的來自控制信號源的控制信號起作用。數據的吞吐異步進行并且獨立于系統環境,其包括以下步驟:在第一FIFO緩沖器的輸入端接收數據、將該數據傳送給數字信號處理器、對數據進行處理、然后將處理過的數據傳送給第二FIFO緩沖器以備當數據接收機準備好接收數據時輸出。
在5,515,329?A中,示出了一個存儲器系統,該系統通過其中包含有數字信號處理器和附屬的動態隨機存取存儲器顯示出處理數據的能力。數字信號處理器提供在空閑時有效的數據處理而附屬的動態隨機存取存儲器陣列提供附加的緩存能力。將輸入和輸出FIFO連接到數字信號處理器的數據和地址總線。利用串行通信鏈接通過主處理器將數字信號處理器控制連接到該數字信號處理器。
US?5,845,093?A公開了一種在集成電路上的數字信號處理器,該處理器采用多端口數據流結構,該結構的特征在于有四個端口即:一個獲取端口、二個數據端口、和一個系數端口。所有四個端口均可以是雙向的,從而可以通過DSP系統從相應端口讀出和向相應端口寫入數據。該結構允許一種數據流管理模式,其中數據通過獲取端口或者任何數據端口之一輸入處理器。當處理數據時,它可以在數據端口之間,或者數據端口與獲取端口之間往復轉換(ping?pong)。在DSP算法結束時,可以通過獲取端口或者數據端口提供輸出數據以滿足具體應用的需要。系數端口通常用于為DSP算法提供系數或旋轉因子。將每一個數據端口附加到專用獨立數據存儲器。這為多通道算法提供了優化。
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